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參數(shù)資料
| 型號： | XRT86SH221IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA388 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-388 |
| 文件頁數(shù)： | 73/353頁 |
| 文件大?。?/td> | 2330K |
| 代理商： | XRT86SH221IB |
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PRELIMINARY
XRT86SH221
64
REV. P1.0.5
SDH-TO-PDH FRAMER/MAPPER WITH INTEGRATED 21-CHANNEL E1 SH LIU
HARDWARE RDI-L INSERTION
Hardware can enable RDI-L insertion by setting the most significant bit of the B2 byte to "1" on the TTOH serial
input line. Note that software must first enable hardware RDI-L insertion. The state of the TTOHIns pin has no
effect during the B2 slots.
TXSTOH_CONT BLOCK
The txstoh_proc has one 8 bit internal data bus interface. The txstoh_cont block provides the register file and
internal processor interface for the transport section of the SDH transmitter. It selects the value of the transport
overhead bytes from either hardware or software according to the control registers and forwards them to the
txstoh_proc block for transmission. The hardware value is specified through a parallel data input port. If the
transport overhead bytes are serially entered into the chip, it is assumed that a serial to parallel data converter
has converted the data to parallel format and has placed the data on the input of the txstoh_cont block at the
appropriate instances during transmission. The txstoh_cont also provides control for the transmission of a
section trace message (J0 byte).
A1/A2 GENERATION
The txstoh_cont block generates alternate A1 and A2 values based on hardware or software requests and
sends them to the txstoh_proc block via the tx_toh_data lines. The txstoh_cont block accepts A1/A2 values
from the hardware input, or alternatively, software can specify an error mask indicating the A1/A2 bytes in
which errors should be inserted for diagnostic purposes. A1/A2 errors are always inserted on frame
boundaries, i.e., the A1/A2 error mask is only sampled at the start of every frame.
B1 ERROR MASK GENERATION
The txstoh_cont block allows software to insert errors into the B1 value calculated and transmitted by the
txstoh_proc block. By writing to an appropriate register bit, a software controlled error mask is used to insert
errors into the B1 byte.
B2 ERROR MASK GENERATION
The txstoh_cont block allows software to control B2 BER generation through two registers: A byte error mask
register and a bit error mask register. The byte error mask specifies which of the B2 bytes are to be corrupted
and the bit error mask specifies which bits are to be inverted in the B2 bytes that are to be corrupted. In the
case of an 8 bit internal data bus, each bit in the B2 byte error mask corresponds to 4 bytes (i.e., one time slot).
The B2 byte and bit error masks are sampled before the first B2 byte of each frame if B2 error insertion is
enabled by software.
SCRAMBLING
The txstoh_cont block allows software to disable scrambling by setting a bit in the control register. Otherwise,
the SDH data is scrambled using the identical algorithm as the de-scrambling process.
K1/K2 CONTROL
The K1/K2 bytes contain the APS code. The APS code transmitted either come from software registers or from
hardware via the TxOH serial pin. Note that the 3 least significant bits of the K2 byte (bits 6, 7 and 8) may be
overridden by an RDI-L alarm.
RDI-L CONTROL (K2 BITS 6, 7, AND 8)
The RDI-L indication bits consist of the 3 least significant bits of the K2 byte. The bits usually contain portions
of the transmitted APS code. However, they are overridden with the RDI-L pattern 3'b110 if any of the following
software configurable conditions occur: LOS, LOF, or AIS-L. RDI-L can also be inserted from hardware via the
TxOH serial pin or forced by software. RDI-L insertion is done according to the following SDH rules:
I
TE shall generate RDI-L within 125
μ
s of detecting an AIS-L defect (or a lower-layer, traffic-related, near-
end defect). The LTE shall generate RDI-L by inserting the code '110' in bits 6, 7, and 8 of the K2 byte.
The lower-layer, traffic-related, near-end defects referred to by R6-200 are LOS and LOF from the receiver
blocks.
相關PDF資料 |
PDF描述 |
|---|---|
| XRT86SH328 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328_07 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86SH328IB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_1 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT86VL32_2 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT86SH221IB-F | 功能描述:網(wǎng)絡控制器與處理器 IC SDH-TO-PDH, VT/TU INTGR 21 CHNL 2FRAME RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH221OR | 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT86SH328 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
| XRT86SH328_07 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL DS1/E1 FRAMER/LIU WITH DS3 MUX & VT-MAPPER - SONET |
| XRT86SH328_08 | 制造商:EXAR 制造商全稱:EXAR 功能描述:28-CHANNEL SONET/SDH VT MAPPER REGISTER DESCRIPTION WITH M13 |
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