- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄200645 > UPD703270GF-XXX-JBT 32-BIT, MROM, 20 MHz, RISC MICROCONTROLLER, PQFP100 PDF資料下載
參數(shù)資料
| 型號(hào)： | UPD703270GF-XXX-JBT |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 20 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 936/1080頁(yè) |
| 文件大?。?/td> | 6965K |
| 代理商： | UPD703270GF-XXX-JBT |
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User’s Manual U16541EJ4V0UD
869
CHAPTER 22 INTERRUPT/EXCEPTION PROCESSING FUNCTION
The V850ES/SG2 is provided with a dedicated interrupt controller (INTC) for interrupt servicing and can process a
total of 71 to 79 interrupt requests.
An interrupt is an event that occurs independently of program execution, and an exception is an event whose
occurrence is dependent on program execution.
The V850ES/SG2 can process interrupt request signals from the on-chip peripheral hardware and external
sources.
Moreover, exception processing can be started by the TRAP instruction (software exception) or by
generation of an exception event (i.e. fetching of an illegal opcode) (exception trap).
22.1 Features
Interrupts
Non-maskable interrupts: 2 sources
Maskable interrupts:
External: 8, Internal: 47/51 sources (see Table 1-1)
8 levels of programmable priorities (maskable interrupts)
Multiple interrupt control according to priority
Masks can be specified for each maskable interrupt request.
Noise elimination, edge detection, and valid edge specification for external interrupt request signals.
Exceptions
Software exceptions: 32 sources
Exception trap:
2 sources (illegal opcode exception)
Interrupt/exception sources are listed in Table 22-1.
Table 22-1. Interrupt Source List (1/4)
Type
Classification
Default
Priority
Name
Trigger
Generating
Unit
Exception
Code
Handler
Address
Restored
PC
Interrupt
Control
Register
Reset
Interrupt
RESET
RESET pin input
Reset input by internal source
RESET
0000H
00000000H
Undefined
NMI
NMI pin valid edge input
Pin
0010H
00000010H
nextPC
Non-
maskable
Interrupt
INTWDT2
WDT2 overflow
WDT2
0020H
00000020H
Note 1
TRAP0n
Note 2
TRAP instruction
004nH
Note 2
00000040H
nextPC
Software
exception
Exception
TRAP1n
Note 2
TRAP instruction
005nH
Note 2
00000050H
nextPC
Exception
trap
Exception
ILGOP/
DBG0
Illegal opcode/
DBTRAP instruction
0060H
00000060H
nextPC
Notes 1. For the restoring in the case of INTWDT2, see 22.2.2 (2) INTWDT2 signal.
2. n = 0 to FH
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PDF描述 |
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參數(shù)描述 |
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| UPD70330GJ-8-5BG | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller |
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