參數(shù)資料
型號： UPD703270GF-XXX-JBT
元件分類： 微控制器/微處理器
英文描述： 32-BIT, MROM, 20 MHz, RISC MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, PLASTIC, QFP-100
文件頁數(shù)： 609/1080頁
文件大小： 6965K
代理商： UPD703270GF-XXX-JBT
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CHAPTER 17 I
2C BUS
User’s Manual U16541EJ4V0UD
574
Table 17-2. Clock Settings (1/2)
IICX0
IICCL0
Bit 0
Bit 3
Bit 1
Bit 0
CLX0
SMC0
CL01
CL00
Selection Clock
Transfer
Clock
Settable Main Clock
Frequency (fXX) Range
Operating
Mode
fXX (when OCKS0 = 18H set)
fXX/44
2.00 MHz
≤ fXX ≤ 4.19 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/88
4.00 MHz
≤ fXX ≤ 8.38 MHz
fXX/3 (when OCKS0 = 11H set)
fXX/132
6.00 MHz
≤ fXX ≤ 12.57 MHz
fXX/4 (when OCKS0 = 12H set)
fXX/176
8.00 MHz
≤ fXX ≤ 16.76 MHz
0
fXX/5 (when OCKS0 = 13H set)
fXX/220
10.00 MHz
≤ fXX ≤ 20.00 MHz
fXX (when OCKS0 = 18H set)
fXX/86
4.19 MHz
≤ fXX ≤ 8.38 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/172
8.38 MHz
≤ fXX ≤ 16.76 MHz
fXX/3 (when OCKS0 = 11H set)
fXX/258
12.57 MHz
≤ fXX ≤ 20.00 MHz
0
1
fXX/4 (when OCKS0 = 12H set)
fXX/344
16.76 MHz
≤ fXX ≤ 20.00 MHz
0
1
0
fXX
Note
fXX/86
4.19 MHz
≤ fXX ≤ 8.38 MHz
fXX (when OCKS0 = 18H set)
fXX/66
6.40 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/132
12.80 MHz
0
1
fXX/3 (when OCKS0 = 11H set)
fXX/198
19.20 MHz
Standard
mode
(SMC0 bit = 0)
fXX (when OCKS0 = 18H set)
fXX/24
4.19 MHz
≤ fXX ≤ 8.38 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/48
8.00 MHz
≤ fXX ≤ 16.76 MHz
fXX/3 (when OCKS0 = 11H set)
fXX/72
12.00 MHz
≤ fXX ≤ 20.00 MHz
0
1
0
×
fXX/4 (when OCKS0 = 12H set)
fXX/96
16.00 MHz
≤ fXX ≤ 20.00 MHz
0
1
0
fXX
Note
fXX/24
4.00 MHz
≤ fXX ≤ 8.38 MHz
fXX (when OCKS0 = 18H set)
fXX/18
6.40 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/36
12.80 MHz
0
1
fXX/3 (when OCKS0 = 11H set)
fXX/54
19.20 MHz
fXX (when OCKS0 = 18H set)
fXX/12
4.00 MHz
≤ fXX ≤ 4.19 MHz
fXX/2 (when OCKS0 = 10H set)
fXX/24
8.00 MHz
≤ fXX ≤ 8.38 MHz
fXX/3 (when OCKS0 = 11H set)
fXX/36
12.00 MHz
≤ fXX ≤ 12.57 MHz
fXX/4 (when OCKS0 = 12H set)
fXX/48
16.00 MHz
≤ fXX ≤ 16.67 MHz
1
0
×
fXX/5 (when OCKS0 = 13H set)
fXX/60
20.00 MHz
1
0
fXX
Note
fXX/12
4.00 MHz
≤ fXX ≤ 4.19 MHz
High-speed
mode
(SMC0 bit = 1)
Other than above
Setting prohibited
Note
Since the selection clock is fXX regardless of the value set to the OCKS0 register, clear the OCKS0 register
to 00H (I
2C division clock stopped status).
Remark
×: don’t care
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PDF描述
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