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參數(shù)資料
| 型號(hào)： | UPD703270GF-XXX-JBT |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 20 MHz, RISC MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 515/1080頁(yè) |
| 文件大小： | 6965K |
| 代理商： | UPD703270GF-XXX-JBT |
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CHAPTER 2 PIN FUNCTIONS
User’s Manual U16541EJ4V0UD
49
2.2
Pin States
The operation states of pins in the various modes are described below.
Table 2-2. Pin Operation States in Various Modes
Pin Name
When Power
Is Turned
On
Note 1
During Reset
(Except When
Power Is
Turned On)
HALT Mode
Note 2
IDLE1, IDLE2,
Sub-IDLE
Mode
Note 2
STOP
Mode
Note 2
Idle
State
Note 3
Bus Hold
P05/DRST
Note 4
Pulled down
Note 5
Held
P10/ANO0,
P11/ANO1
Hi-Z
Held
Hi-Z
Held
P53/DDO
Note 4
Undefined
Hi-Z
Note 6
Held
AD0 to AD15
Notes 8, 9
A0 to A15
Undefined
Notes 8, 10
A16 to A23
Undefined
Note 8
Hi-Z
Held
Hi-Z
WAIT
CLKOUT
Operating
L
Operating
WR0, WR1
RD
ASTB
H
Note 8
Hi-Z
HLDAK
H
L
HLDRQ
Operating
Notes 8, 10
Operating
CS0 to CS3
Hi-Z
Note 7
Hi-Z
Note 7
H
Note 8
H
Held
Hi-Z
Other port pins
Hi-Z
Held
Notes 1. Duration until 1 ms elapses after the supply voltage reaches the operating supply voltage range (lower
limit) when the power is turned on.
2. Operates while an alternate function is operating.
3. In separate bus mode, the state of the pins in the idle state inserted after the T2 state is shown. In
multiplexed bus mode, the state of the pins in the idle state inserted after the T3 state is shown.
4. Flash memory version only
5. Pulled down during external reset. During internal reset by the watchdog timer, clock monitor, etc., the
state of this pin differs according to the OCDM.OCDM0 bit setting.
6. DDO output is specified in the on-chip debug mode.
7. The bus control pins function alternately as port pins, so they are initialized to the input mode (port
mode).
8. Operates even in the HALT mode, during DMA operation.
9. In separate bus mode: Hi-Z
In multiplexed bus mode: Undefined
10. In separate bus mode
Remark
Hi-Z: High impedance
Held: The state during the immediately preceding external bus cycle is held.
L:
Low-level output
H:
High-level output
:
Input without sampling (not acknowledged)
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