參數(shù)資料
型號： UPD703270GF-XXX-JBT
元件分類： 微控制器/微處理器
英文描述： 32-BIT, MROM, 20 MHz, RISC MICROCONTROLLER, PQFP100
封裝： 14 X 20 MM, PLASTIC, QFP-100
文件頁數(shù)： 1067/1080頁
文件大?。?/td> 6965K
代理商： UPD703270GF-XXX-JBT
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CHAPTER 31 ON-CHIP DEBUG FUNCTION
User’s Manual U16541EJ4V0UD
987
(3) DMS
This is a transfer mode select signal. The transfer status in the debug unit changes depending on the level of
the DMS signal.
(4) DDI
This is a data input signal. It is sampled in the on-chip debug unit at the rising edge of DCK.
(5) DDO
This is a data output signal. It is output from the on-chip debug unit at the falling edge of the DCK signal.
(6) EVDD
This signal is used to detect VDD of the target system. If VDD from the target system is not detected, the
signals output from the IE-V850E1-CD-NW (DRST, DCK, DMS, DDI, FLMD0, and RESET) go into a high-
impedance state.
(7) FLMD0
The flash self programming function is used for the function to download data to the flash memory via the
integrated debugger. During flash self programming, the FLMD0 pin must be kept high. In addition, connect a
pull-down resistor to the FLMD0 pin.
The FLMD0 pin can be controlled in either of the following two ways.
<1>
To control from IE-V850E1-CD-NW
Connect the FLMD0 signal of the IE-V850E1-CD-NW to the FLMD0 pin.
In the normal mode, nothing is driven by the IE-V850E1-CD-NW (high impedance).
During a break, the IE-V850E1-CD-NW raises the FLMD0 pin to the high level when the download
function of the integrated debugger is executed.
<2>
To control from port
Connect any port of the device to the FLMD0 pin.
The same port as the one used by the user program to realize the flash self programming function may
be used.
On the console of the integrated debugger, make a setting to raise the port pin to high level before
executing the download function, or lower the port pin after executing the download function.
For details, refer to the ID850QB Ver. 2.80 Integrated Debugger Operation User’s Manual (U16973E).
(8) RESET
This is a system reset input pin. If the DRST pin is made invalid by the value of the OCDM0 bit of the OCDM
register set by the user program, on-chip debugging cannot be executed. Therefore, reset is effected by the
IE-V850E1-CD-NW, using the RESET pin, to make the DRST pin valid (initialization).
相關PDF資料
PDF描述
UPD70F3008GJ-33-8EU 32-BIT, FLASH, 33 MHz, MICROCONTROLLER, PQFP144
UPD70F3017AYF1-EA6-A 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA121
UPD70F3015BGC-8EU-A 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP100
UPD70F3038F1-EN2 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA180
UPD70F3040F1-EN2 32-BIT, FLASH, 20 MHz, MICROCONTROLLER, PBGA180
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UPD70327L-8-XXX 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller
UPD70330GJ-8 制造商:未知廠家 制造商全稱:未知廠家 功能描述:16-Bit Microcontroller
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