參數(shù)資料
型號(hào)： OR4E02-2BM680I
英文描述： FPGA
中文描述： FPGA的
文件頁數(shù)： 95/153頁
文件大?。?/td> 2737K
代理商： OR4E02-2BM680I
Lattice Semiconductor
95
Data Sheet
November, 2002
ORCA
Series 4 FPGAs
Timing
Characteristics
(continued)
Table
59.
Master
Serial
Configuration
Mode
Timing
Characteristics
OR4Exx
commercial/industrial:
VDD15
=
1.4
V
to
1.6
V,
VDD33
=
3.0
V
to
3.6
V,
VDDIO
=
3.0
V
to
3.6
V,
–40
°C
<
TJ
<
+125
°C;
CL
=
30
pF.
Note:
Serial
configuration
data
is
transmitted
out
on
DOUT
on
the
rising
edge
of
CCLK
after
it
is
input
on
DIN.
* Data
gets
clocked
out
from
an
external
serial
ROM.
The
clock
to
data
delay
of
the
serial
ROM
must
be
less
than
the
CCLK
frequency
since
the
data
available
out
of
the
serial
ROM
must
be
setup
and
waiting
to
be
clocked
into
the
FPGA
before
the
next
CCLK
rising
edge.
5-4532(F).b
Figure
54.
Master
Serial
Configuration
Mode
Timing
Diagram
Parameter
Symbol
T
S
T
H
F
C
F
C
T
D
Min
10.00
0.00
5.00
0.63
—
Max
—
—
16.67
2.08
5.00
Unit
ns
ns
MHz
MHz
ns
DIN
Setup
Time*
DIN
Hold
Time
CCLK
Frequency
(M3
=
0)
CCLK
Frequency
(M3
=
1)
CCLK
to
DOUT
Delay
DIN
CCLK
DOUT
T
S
T
H
BIT N
BIT N
T
D
相關(guān)PDF資料
PDF描述
OR4E02-3BA352C FPGA
OR4E02-3BM416C FPGA
OR4E02-3BM680C FPGA
OR4E04-1BA352C FPGA
OR4E04-1BA352I FPGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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OR4E04 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:ORCASeries 4 FPGAs
OR4E04-1BA3521 制造商:Rochester Electronics LLC 功能描述: 制造商:Lattice Semiconductor Corporation 功能描述:
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