參數(shù)資料
型號(hào)： OR3L225B
廠(chǎng)商： Lineage Power
英文描述： Field-Programmable Gate Arrays(現(xiàn)場(chǎng)可編程門(mén)陣列)
中文描述： 現(xiàn)場(chǎng)可編程門(mén)陣列（現(xiàn)場(chǎng)可編程門(mén)陣列）
文件頁(yè)數(shù)： 27/88頁(yè)
文件大?。?/td> 2015K
代理商： OR3L225B
Lucent Technologies Inc.
27
Data Addendum
December 1999
ORCA OR3LxxxB Series FPGAs
Timing Characteristics
(continued)
Table 16. OR3Lxxx
ExpressCLK
to Output Delay (Pin-to-Pin)
OR3LxxB Commercial: V
DD
= 3.0 V to 3.6 V, V
DD
2 = 2.38 V to 2.63 V, 0 °C
<
T
A
<
70 °C; Industrial: V
DD
= 3.0 V
to 3.6 V, V
DD
2 = 2.38 V to 2.63 V, –40 °C
<
T
A
<
+85 °C.
Notes:
Timing is without the use of the PCM.
This clock delay is for a fully routed clock tree that uses the ExpressCLK network. It includes both the input
buffer delay, the clock routing to the PIO CLK input, the clock
→
Q of the FF, and the delay through the output
buffer. The given timing requires that the input clock pin be located at one of the six ExpressCLK inputs of the
device, and that a PIO FF be used.
5-4846 (F)c
Figure 6. ExpressCLK to Output Delay
Description
(T
J
= 85 °C, V
DD
= min, V
DD
2 = min)
Device
-7
-8
Unit
Min
Max
Min
Max
ECLK Middle Input Pin
→
OUTPUT
Pin (Fast)
ECLK Middle Input Pin
→
OUTPUT
Pin (Slewlim)
ECLK Middle Input Pin
→
OUTPUT
Pin (Sinklim)
Additional Delay if ECLK Corner Pin
Used
OR3L165
OR3L225
OR3L165
OR3L225
OR3L165
OR3L225
OR3L165
OR3L225
—
—
—
—
—
—
—
—
6.94
6.99
7.79
7.84
12.91
12.96
2.70
2.90
—
—
—
—
—
—
—
—
5.84
5.89
6.64
6.69
11.08
11.13
2.21
2.38
ns
ns
ns
ns
ns
ns
ns
ns
OUTPUT (50 pF LOAD)
Q
D
ECLK
PIO FF
相關(guān)PDF資料
PDF描述
OR3LP26B Field-Programmable System Chip，Embedded Master/Target PCI Bus Interface(現(xiàn)場(chǎng)可編程系統(tǒng)芯片，嵌入式主機(jī)/從機(jī)PCI總線(xiàn)接口)
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OR4E14 Field-Programmable Gate Arrays(現(xiàn)場(chǎng)可編程門(mén)陣列)
OR4E2 Field-Programmable Gate Arrays(現(xiàn)場(chǎng)可編程門(mén)陣列)
OR4E4 Field-Programmable Gate Arrays(現(xiàn)場(chǎng)可編程門(mén)陣列)
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參數(shù)描述
OR3L225B7BC432-DB 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 11552 LUT 612 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
OR3L225B7BC432I-DB 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 11552 LUT 612 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
OR3L225B7BM680-DB 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 11552 LUT 612 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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