參數(shù)資料
型號： OR3L225B
廠商： Lineage Power
英文描述： Field-Programmable Gate Arrays(現(xiàn)場可編程門陣列)
中文描述： 現(xiàn)場可編程門陣列（現(xiàn)場可編程門陣列）
文件頁數(shù)： 25/88頁
文件大小： 2015K
代理商： OR3L225B
Lucent Technologies Inc.
25
Data Addendum
December 1999
ORCA OR3LxxxB Series FPGAs
Timing Characteristics
(continued)
Clock Timing
Table 14. ExpressCLK (ECLK) and Fast Clock (FCLK) Timing Characteristics
OR3LxxB Commercial: V
DD
= 3.0 V to 3.6 V, V
DD
2 = 2.38 V to 2.63 V, 0 °C
<
T
A
<
70 °C; Industrial: V
DD
= 3.0 V
to 3.6 V, V
DD
2 = 2.38 V to 2.63 V, –40 °C
<
T
A
<
+85 °C.
Notes:
The ECLK delays are to all of the PICs on one side of the device for middle pin input, or two sides of the device for corner pin input.
The delay includes both the input buffer delay and the clock routing to the PIC clock input.
The FCLK delays are for a fully routed clock tree that uses the ExpressCLK input into the fast clock network. It includes both the
input buffer delay and the clock routing to the PFU CLK input. The delay will be reduced if any of the clock branches are not used.
Symbol
Device
(T
J
= 85 °C, V
DD
= min, V
DD
2 = min)
-7
-8
Unit
Min
0.31
Max
—
Min
0.27
Max
—
ECLKC_DEL
Clock Control Timing Delay Through CLKCNTRL
(input from corner)
Delay Through CLKCNTRL (input from
internal clock controller PAD)
Clock Shutoff Timing:
Setup from Middle ECLK (shut off to CLK)
Hold from Middle ECLK (shut off from CLK)
Setup from Corner ECLK (shut off to CLK)
Hold from Corner ECLK (shut off from CLK)
ECLK Delay (middle pad):
OR3L165
OR3L225
ECLK Delay (corner pad):
OR3L165
OR3L225
FCLK Delay (middle pad):
OR3L165
OR3L225
FCLK Delay (corner pad):
OR3L165
OR3L225
ns
ECLKM_DEL
1.06
—
0.92
—
ns
OFFM_SET
OFFM_HLD
OFFC_SET
OFFC_HLD
ECLKM_DEL
0.41
0.0
0.41
0.0
—
—
—
—
0.36
0.0
0.36
0.0
—
—
—
—
ns
ns
ns
ns
—
—
2.32
2.37
—
—
2.02
2.07
ns
ns
ECLKC_DEL
—
—
5.02
5.27
—
—
4.23
4.45
ns
ns
FCLKM_DEL
—
—
5.74
6.04
—
—
5.06
5.35
ns
ns
FCLKC_DEL
—
—
8.41
8.89
—
—
7.24
7.68
ns
ns
相關PDF資料
PDF描述
OR3LP26B Field-Programmable System Chip，Embedded Master/Target PCI Bus Interface(現(xiàn)場可編程系統(tǒng)芯片，嵌入式主機/從機PCI總線接口)
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OR4E14 Field-Programmable Gate Arrays(現(xiàn)場可編程門陣列)
OR4E2 Field-Programmable Gate Arrays(現(xiàn)場可編程門陣列)
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參數(shù)描述
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