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參數(shù)資料
| 型號： | OMAP5910(RISC) |
| 英文描述： | Dual-Core Processor |
| 中文描述： | 雙核處理器 |
| 文件頁數(shù)： | 69/160頁 |
| 文件大小： | 1997K |
| 代理商： | OMAP5910(RISC) |
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Functional Overview
57
August 2002 Revised August 2003
SPRS197B
C = 10
μ
F
VDD
ULPD DPLL
(for USB)
CVDD4
Voltage
Regulator
Common CVDD for
Rest of Chip
R = 10
VSS
OMAP5910
CVDDx
Dedicated CVDD for
USB DPLL
CVDDA
OMAP DPLL
Dedicated CVDD for
ULPD DPLL
This circuit is provided only as an example. Specific board layout implementation must minimize noise on the OMAP5910 voltage supply pins.
Except where stated otherwise in this document, all VSS pins on the OMAP5910 are common and must be connected directly to a common
ground; however, the discrete capacitor in the RC filter circuit should be placed as close as possible to the VSS (GZG balls AA1/Y3 or GDY balls
E13/K9).
§For special consideration with respect to the connection of VSS (GZG ball V12 or GDY ball F6), refer to Section 5.6.1,
32-kHz Oscillator and Input
Clock
.
The voltage regulator must be selected to provide a voltage source with minimal low frequency noise.
Figure 36. External RC Circuit for DPLL CV
DD
Noise Isolation
3.15 MPU Register Descriptions
The following tables describe the MPU registers including register addresses, descriptions, required access
widths, access types (R = read, W = write, RW = read/write) and reset values. These tables are organized
by function with like peripherals or functions together and are therefore not necessarily in the order of
ascending register addresses.
NOTE:
All accesses to these registers must be of the data access widths indicated to avoid
a TIPB bus error condition and a corresponding interrupt. Reserved addresses should never
be accessed.
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