參數(shù)資料
型號： OMAP5910(RISC)
英文描述： Dual-Core Processor
中文描述： 雙核處理器
文件頁數(shù)： 126/160頁
文件大?。?/td> 1997K
代理商： OMAP5910(RISC)
Electrical Specifications
114
August 2002 Revised August 2003
SPRS197B
Table 511. EMIFS/Flash Interface Switching Characteristics
NO.
PARAMETER
DVDD5 = 1.8 V
Nominal
DVDD5 = 2.75 V
Nominal
DVDD5 = 3.3 V
Nominal
UNIT
MIN
MAX
MIN
MAX
MIN
MAX
F1
td(CLKHCSV)
Delay time,
FLASH.CLK high
to FLASH.CSx
transition
async
modes
0
0
0
ns
sync
modes
1
12
1
11
1
10
F2
td(CLKHBEV)
Delay time,
FLASH.CLK high
to FLASH.BEx
valid
async
modes
9
2
9
2
9
2
ns
sync
modes
1
4
1
4
1
3
F3
td(CLKHBEIV)
Delay time,
FLASH.CLK high
to FLASH.BEx
invalid
async
modes
9
2
9
2
9
2
ns
sync
modes
1
4
1
4
1
3
F4
td(CLKHAV)
Delay time,
FLASH.CLK high
to address valid
async
modes
7
6
7
6
7
6
ns
sync
modes
1
9
0
8
0
7
F5
td(CLKHAIV)
Delay time,
FLASH.CLK high
to address invalid
async
modes
7
6
7
6
7
6
ns
sync
modes
1
9
1
8
1
7
F8
td(CLKHADV)
Delay time,
FLASH.CLK high
to FLASH.ADV
transition
async
modes
10
1
10
1
9
1
ns
sync
modes
1
3
1
3
1
2
F9
td(CLKHOEV)
Delay time,
FLASH.CLK high
to FLASH.OE
transition
async
modes
8
1
8
1
8
1
ns
sync
modes
1
4
1
3
1
3
F12
td(CLKHWEV)
Delay time,
FLASH.CLK high
to FLASH.WE
transition
async
modes
8
1
8
1
8
1
ns
sync
modes
1
4
1
3
1
3
F13
td(CLKHWDV)
Delay time,
FLASH.CLK high
to write data valid
async
modes
15
7
15
7
14
7
ns
sync
modes
4
7
3
6
3
6
F14
td(CLKHWDIV)
Delay time,
FLASH.CLK high
to write data
invalid
async
modes
15
7
15
7
15
7
ns
sync
modes
4
7
3
6
3
6
F15
td(CLKHDHZ)
Delay time, FLASH.CLK high
to data bus high-impedance
16
15
14
ns
F16
td(CLKHDLZ)
Delay time, FLASH.CLK high
to data bus driven
4
7
3
6
3
6
ns
F17
td(CLKHBAAV)
Delay time, FLASH.CLK high
to FLASH.BAA transition
1 + 0.5P
8 + 0.5P
1 + 0.5P
7.5 + 0.5P
1 + 0.5P
7.5 + 0.5P
ns
Data is referenced to the internal FLASH.CLK. For async modes, td(CLKHCSV) with respect to internal FLASH.CLK is given as 0 to allow for other
signals reference to FLASH.CSx. The external FLASH.CLK is disabled for async modes.
P = period of undivided Traffic Controller clock regardless of FLASH.CLK divider configuration
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