參數(shù)資料
型號： MC145574
廠商： Motorola, Inc.
英文描述： ISDN S/T-Interface Transceiver
中文描述： 綜合業(yè)務(wù)數(shù)字網(wǎng)S / T的接口收發(fā)器
文件頁數(shù)： 93/164頁
文件大?。?/td> 1072K
代理商： MC145574
MC145574
10–3
MOTOROLA
(7)
(6)
(5)
(4)
(3)
(2)
(1)
(0)
OR3
Dout B1 Channel Timeslot Bits (7:0)
OR3(7:0) — Rx B1 Channel Timeslot
This register allows the B1 channel timeslot output from the Dout pin to be allocated 1 of 256 start
points, corresponding to each 2–bit boundary defined by the CLK. The timeslot can be either 8 or
10 CLKs wide. The default value for OR3 is 00H.
(7)
(6)
(5)
(4)
(3)
(2)
(1)
(0)
OR4
Dout B2 Channel Timeslot Bits (7:0)
OR4(7:0) — Rx B2 Channel Timeslot
This register allows the B2 channel timeslot output from the Dout pin to be allocated 1 of 256 start
points, corresponding to each 2–bit boundary defined by the CLK. The timeslot can be either 8 or
10 CLKs wide. The default value for OR4 is 04H.
(7)
(6)
(5)
(4)
(3)
(2)
(1)
(0)
OR5
Dout D Channel Timeslot Bits (7:0)
(GCI Indirect Mode)
OR5
S2
S1
S0
OR5(7:0) — Rx D Channel Timeslot
This register allows the D channel timeslot output from the Dout pin to be allocated 1 of 256 start points,
corresponding to each 2–bit boundary defined by the CLK. The default value for OR5 is 08H.
OR5(2:0) — GCI Timeslot, S(2:0)
In GCI indirect mode, control of the GCI timeslot is available through the S(2:0) bits. S(2:0)=0H is
the initialized state, timeslot 0. The timeslot selected must be compatible with the GCI DCL clock rate
being used; i.e., if the clock rate is 2048 kHz, only the first four timeslots are available. Bits 7:3 must
be programmed as 0.
Table 10–3. S(2:0) GCI Timeslot
Assignment
S2
S1
S0
Timeslot
0
0
0
0
0
0
1
1
0
1
0
2
0
1
1
3
1
0
0
4
1
0
1
5
1
1
0
6
1
1
1
7
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述
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MC145574AEG 制造商:Freescale Semiconductor 功能描述:
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