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參數資料
| 型號： | M37640E8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCONTROLLER |
| 中文描述： | 單芯片8位CMOS單片機 |
| 文件頁數： | 80/172頁 |
| 文件大小： | 1193K |
| 代理商： | M37640E8 |
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2-68
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Master CPU Bus Interface
7600 Series
M37640E8-XXXF Preliminary Specification
Mitsubishi Microcomputers
2.10.1 Data Bus Buffer Status Registers (DBBS0, DBBS1)
The data bus buffer status register is an 8-bit register that indicates the data bus status, with bits 0, 1,
and 3 being dedicated read-only bits. Bits 2, 4, 5, 6, and 7 are user definable flags set by software, and
can be read and write. When the A
0
pin is high, the master CPU can read the contents of this register.
Output Buffer Full Flag (OBF
0
, OBF
1
)
The OBF
0
and the OBF
1
flags are set high when data is written to the output data bus buffer by the
slave CPU and is cleared to “0” when data is read by the master CPU.
Input Buffer Full Flag (IBF
0
, IBF
1
)
The IBF
0
and the IBF
1
flags are set high when data is written to the input data bus buffer by the
master CPU and is cleared to “0” when data is read by the slave CPU.
A
0
Flag (A
00
, A
01
)
The level of the A
0
pin is latched when data has been written from the host CPU to the input data
bus buffer.
2.10.2 Input Data Bus Buffer Registers (DBBIN
0
, DBBIN
1
)
The data on the data bus is latched into DBBIN
0
or DBBIN
1
by a write request from the master CPU.
The data in DBBIN
0
or DBBIN
1
can be read from the data bus buffer register in the SFR area.
2.10.3 Output Data Bus Buffer Registers (DBBOUT
0
, DBBOUT
1
)
Data is set in DBBOUT
0
or DBBOUT
1
by writing to the data bus buffer register in the SFR area.
When the A
0
pin is low, the data of this register is output by a read request from the host CPU.
相關PDF資料 |
PDF描述 |
|---|---|
| M37641F8-XXXFP | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| M37641F8-XXXHP | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
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| M37641M8 | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
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相關代理商/技術參數 |
參數描述 |
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