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參數(shù)資料
| 型號： | M37640E8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCONTROLLER |
| 中文描述： | 單芯片8位CMOS單片機 |
| 文件頁數(shù)： | 157/172頁 |
| 文件大小： | 1193K |
| 代理商： | M37640E8 |
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7600 Series
Mitsubishi Microcomputer
M37640E8-XXXF Preliminary Specification
6/2/98
5-7
Figure 5-13. Clock Control Register
Figure 5-14. TXM Register
Bits 0-3
CCR4:
Reserved (Read/Write “0”)
PLL Bypass Bit (bit 4)
0: f
USB
= f
VCO
(Frequency synthesizer output)
1: f
= f
XC
Oscillation Drive Disable Bit (bit 5)
0: XC
out
oscillation drive is enabled (when XC
in
oscillation is enabled).
1: XC
oscillation drive is disabled.
X
out
Oscillation Drive Disable Bit (bit 6)
0: X
out
oscillation drive is enabled (when X
in
oscillation is enabled).
1: X
oscillation drive is disabled.
X
in
Divider Select Bit (bit 7)
0: f
Xin
/2 is used for the system clock source when CMPA7:6=00
1: f
Xin
is used for the system clock source when CMPA7:6=00
CCR5:
CCR6:
CCR7:
MSB
7
LSB
0
Reserved
Reserved
Reserved
Access: R/W
Reset: 00
16
Reserved
Address: 001F
16
CCR4
CCR7
CCR6
CCR5
TXM0
Timer X Data Write Control Bit (bit 0)
0: Write data in latch and timer
1: Write data in latch only
Timer X Frequency Division Ratio Bits (bits 2,1)
Bit 2
Bit 1
0
0:
0
1:
1
0:
1
1:
Timer X Internal Clock Select (bit 3)
0:
Φ
/n
1: SCSGCLK (from chip special count source generator)
Timer X Mode Bits (bits 5,4)
Bit 5
Bit 4
0
0:
Timer Mode
0
1:
Pulse output mode
1
0:
Event counter mode
1
1:
Pulse width measurement mode
CNTR0 Polarity Select Bit (bit 6)
0: For event counter mode, clocked by rising edge
For pulse output mode, start from high level output
For CNTR0 interrupt request, falling edge active
For pulse width measurement mode, measure high period
1: For event counter mode, clocked on falling edge
For pulse output mode, start from low level output
For CNTR0 interrupt request, rising edge active
For pulse width measurement mode, measure low period
Timer X Stop Bit (bit 7)
0: Count start
1: Count stop
TXM2,1
Φ
divided by 8
Φ
divided by 16
Φ
divided by 32
Φ
divided by 64
TXM3
TXM5,4
TXM6
TXM7
MSB
7
LSB
0
TXM7
TXM6
TXM5
TXM4
TXM3
TXM2
TXM1
TXM0
Access: R/W
Reset: 00
16
Address: 0027
16
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M37641F8-XXXFP | SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
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