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參數(shù)資料
| 型號： | M37640E8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCONTROLLER |
| 中文描述： | 單芯片8位CMOS單片機 |
| 文件頁數(shù)： | 168/172頁 |
| 文件大?。?/td> | 1193K |
| 代理商： | M37640E8 |
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5-18
6/2/98
7600 Series
M37640E8-XXXF Preliminary Specification
Mitsubishi Microcomputers
Figure 5-42. Endpoints 1, 2, 3, 4 IN CSR
Figure 5-43. Endpoint 0 OUT CSR
Figure 5-44. Endpoint 1, 2, 3, 4 OUT CSR
INXCSR0
IN_PKT_RDY Bit (bit 0) (Write “1” only or Read)
0: In packet is not ready
1: In packet is ready
UNDER_RUN Flag (bit 1) (Write “0” only or Read)
0: No FIFO underrun
1: FIFO underrun has occurred
SEND_STALL Bit (bit 2)
0: No action
1: Stall IN Endpoint X by the CPU
ISO Bit (bit 3)
0: Select non-isochronous transfer
1: Select isochronous transfer
INTPT Bit (bit 4)
0: Select non-rate feedback interrupt transfer
1: Select rate feedback interrupt transfer
TX_NOT_EPT Flag (bit 5) (Read Only - Write “0”)
0: Transmit FIFO is empty
1: Transmit FIFO is not empty
FLUSH Bit (bit 6) (Write Only - Read “0”)
0: No action
1: Flush the FIFO
AUTO_SET Bit (bit 7)
0: AUTO_SET disabled
1: AUTO_SET enabled
INXCSR1
INXCSR2
INXCSR3
INXCSR4
INXCSR5
INXCSR6
INXCSR7
MSB
7
LSB
0
INXCSR7
INXCSR6
INXCSR5
INXCSR4
INXCSR3
INXCSR1
INXCSR0
Access: R/W
Reset: 00
16
INXCSR2
Address: 0059
16
Bits 7:0
Reserved (Read “0”)
MSB
7
LSB
0
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Reserved
Access: R
Reset: 00
16
Address: 005A
16
Reserved
OUTXCSR0
OUT_PKT_RDY Flag (bit 0) (Write “0” only or Read)
0: Out packet is not ready
1: Out packet is ready
OVER_RUN Flag (bit 1) (Write “0” only or Read)
0: No FIFO overrun
1: FIFO overrun occurred
SEND_STALL Bit (bit 2)
0: No action
1: Stall OUT Endpoint X by the CPU
ISO Bit (bit 3)
0: Select non-isochronous transfer
1: Select isochronous transfer
FORCE_STALL Flag (bit 4) (Write “0” only or Read)
0: No action
1: Stall Endpoint X by the USB FCU
DATA_ERR Flag (bit 5) (Write “0” only or Read)
0: No error
1: CRC or bit stuffing error received in an ISO packet
FLUSH Bit (bit 6) (Write Only - Read “0”)
0: No action
1: Flush the FIFO
AUTO_CLR Bit (bit 7)
0: AUTO_CLR disabled
1: AUTO_CLR enabled
OUTXCSR1
OUTXCSR2
OUTXCSR3
OUTXCSR4
OUTXCSR5
OUTXCSR6
OUTXCSR7
MSB
7
LSB
0
OUTXCSR7 OUTXCSR6 OUTXCSR5 OUTXCSR4 OUTXCSR3
OUTXCSR1 OUTXCSR0
Access: R/W
Reset: 00
16
OUTXCSR2
Address: 005A
16
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PDF描述 |
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