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參數(shù)資料
| 型號(hào)： | M37640E8 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 8-BIT CMOS MICROCONTROLLER |
| 中文描述： | 單芯片8位CMOS單片機(jī) |
| 文件頁數(shù)： | 159/172頁 |
| 文件大小： | 1193K |
| 代理商： | M37640E8 |
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7600 Series
Mitsubishi Microcomputer
M37640E8-XXXF Preliminary Specification
6/2/98
5-9
Figure 5-17. SIO Control Register 1
Figure 5-18. SIO Control Register 2
Figure 5-19. SCSGM Register
MSB
7
LSB
0
SCSel
TDSel
RDYSel
PSel
ISCSel1
ISCSel0
ISCSel0-2
Internal Synchronization Clock Select Bits (bits 2,1,0)
Bit 2
Bit 1
Bit 0
0
0
0
0
0
1
0
1
1
0
1
0
1
1
1
1
SIO Port Selection Bit (bit 3)
0: I/O Port
1: TxD output, SCLK function
SRDY Output Select Bit (bit 4)
0: I/O Port
1: SRDY signal
Transfer Direction Select Bit (bit 5)
0: LSB first
1: MSB first
Synchronization Clock Select Bit (bit 6)
0: External Clock
1: Internal Clock
TxD Output Channel Control Bit (bit 7)
0: CMOS output
1: N-Channel open drain output
0:
1:
0:
1:
0:
1:
0:
1:
Internal Clock divided by 2.
Internal Clock divided by 4.
Internal Clock divided by 8.
Internal Clock divided by 16.
Internal Clock divided by 32.
Internal Clock divided by 64.
Internal Clock divided by 128.
Internal Clock divided by 256.
PSel
RDYSel
TDSel
SCSel
OCHCont
Access: R/W
Reset: 00
16
ISCSel2
OCHCont
Address: 002B
16
SLAVE
Slave Mode Selection Bit (bit 0)
0: Normal mode
1: Slave mode (to enter Slave mode, bit 4 of SIO Control register 1 also needs to be set)
SIO Internal Clock Selection Bit (bit 1)
0:
Φ
1: SCSGCLK
SRXD Input Selection Bit (bit 2)
0: SRXD input disabled
1: SRXD input enabled
Reserved (Read/Write “1”)
Reserved (Read/Write “0”)
CLKSEL
RXDSel
Bits 3-4
Bits 5-7
MSB
7
LSB
0
CLKSEL
SLAVE
Access: R/W
Reset:
RXDSel
Reserved
Address: 002C
16
Reserved
Reserved
Reserved
Reserved
18
16
MSB
7
LSB
0
SCSGM3
SCSGM1
SCSGM0
SCSGM0
SCSG1 Data Write Control Bit (bit 0)
0: Write data in latch and timer
1: Write data in latch only
SCSG1 Count Stop Bit (bit 1)
0: Count start
1: Count stop
SCSG2 Data Write Control Bit (bit 2)
0: Write data in latch and timer
1: Write data in latch only
SCSGCLK Output Control Bit (bit 3)
0: SCSGCLK output disabled (SCSG1 and SCSG2 off)
1: SCSGCLK output enabled.
Reserved (Read/Write “0”)
SCSGM1
SCSGM2
SCSGM3
Bits 4-7
Access: R/W
Reset: 00
16
SCSGM2
Address: 002F
16
Reserved
Reserved
Reserved
Reserved
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