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參數(shù)資料
| 型號(hào)： | L84302 |
| 元件分類(lèi)： | 通用總線功能 |
| 英文描述： | L84302 Quad 100/10 Mbps 4-Port Ethernet Controller with RMON/SNMP Management Counters technical manual 4/02 |
| 中文描述： | L84302四100/10 Mbps的4端口以太網(wǎng)的遠(yuǎn)程監(jiān)控控制器/ SNMP管理處的技術(shù)手冊(cè)，4月2日 |
| 文件頁(yè)數(shù)： | 54/128頁(yè) |
| 文件大?。?/td> | 997K |
| 代理商： | L84302 |
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April, 2002
L84302 Quad 4-Port Ethernet Controller - Technical Manual
Copyright 1997-2002 by LSI Logic Corporation. All rights reserved.
Figure 7
Autogenerated Pause Frame Format
00000000
00000000
P[0:7] Flow Ctrl. Pause Reg 1
P[0:7] Flow Ctrl. Pause Reg 0
1
1
1
1
1
1010
1010
1010
1011
MAC
PHY
Interface
10101010
10101010
10101010
10101010
10101010
10101010
10101010
10101011
PRE
SFD
DA
SA
OP
FCS
FCS[31:24]
FCS[23:16]
FCS[15:8]
FCS[7:0]
0000
0000
0
0
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
FCS[31:28]
FCS[27:24]
FCS[3:0]
0000
0000
0
0
MSB
TXEN/
RXDV
TXEN/
CRS
Bits
Transmitted
MII
Serial
LSB
Bits
Transmitted
Bytes
Transmitted
10000000
00000001
01000011
00000000
00000000
10000000
A[7:0] Sta. Addr. Reg 0
A[7:0] Sta. Addr. Reg 1
A[7:0] Sta. Addr. Reg 2
A[7:0] Sta. Addr. Reg 3
A[7:0] Sta. Addr. Reg 4
A[7:0] Sta. Addr. Reg 5
00010001
00010000
00000000
10000000
L/T
PARAM
1000
0000
0000
0001
0100
0011
0000
0000
0000
0000
1000
0000
A[0:3] Sta. Addr. Reg 0
A[4:7] Sta. Addr. Reg 0
A[0:3] Sta. Addr. Reg 1
A[4:7] Sta. Addr. Reg 1
A[7:0] Sta. Addr. Reg 5
0001
0001
0001
0000
0000
0000
1000
0000
P[0:3] Flow Ctrl. Pause Reg 1
P[4:7] Flow Ctrl. Pause Reg 1
P[0:3] Flow Ctrl. Pause Reg 0
P[4:7] Flow Ctrl. Pause Reg 0
0000
0000
Data
PAD
(42 Bytes)
10 Mbytes
TXD0
RXD0
TXD1
RXD1
TXD2
RXD2
TXD3
RXD3
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