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參數(shù)資料
| 型號： | L84302 |
| 元件分類： | 通用總線功能 |
| 英文描述： | L84302 Quad 100/10 Mbps 4-Port Ethernet Controller with RMON/SNMP Management Counters technical manual 4/02 |
| 中文描述： | L84302四100/10 Mbps的4端口以太網(wǎng)的遠程監(jiān)控控制器/ SNMP管理處的技術(shù)手冊，4月2日 |
| 文件頁數(shù)： | 34/128頁 |
| 文件大?。?/td> | 997K |
| 代理商： | L84302 |
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April, 2002
L84302 Quad 4-Port Ethernet Controller - Technical Manual
Copyright 1997-2002 by LSI Logic Corporation. All rights reserved.
The reception of MAC Control frames is unaffected by any of the
multicast packet address filtering functions and is controlled by other bits
described in the
Section 3.16, “MAC Control Frames,” page 52
.
F[7:0] are bytes in Hash Filter 0-7 Registers.
Fx[7:0] are bits within each byte in Hash Filter 0-7 Registers.
Bits 0-5 are the six least significant bits of the CRC.
3.5.6 Broadcast Address Filter
The device does not do any filtering on broadcast packets. However, the
device can be programmed to accept or reject broadcast packets,
regardless of their address, by appropriately setting the receive address
match select bits in the RX Command register.
The reception of MAC Control frames is unaffected by any of the
broadcast packet address filtering functions and is controlled by other
bits described in
Section 3.16, “MAC Control Frames,” page 52
.
3.5.7 Reject Or Accept All Packets
The device can be programmed to accept or reject all packets regardless
of type or whether the packet passes the address filter by appropriately
setting the receive address match select bits in the RX Command
register.
Table 5
Multicast Address Filter Map
FCS Bits [0:2]
Address Filter Byte
FCS Bits [3:5]
Address Filter Bit
000
F0[7:0]
000
Fx[0]
001
F1[7:0]
001
Fx[1]
010
F2[7:0]
010
Fx[2]
011
F3[7:0]
011
Fx[3]
100
F4[7:0]
100
Fx[4]
101
F5[7:0]
101
Fx[5]
110
F6[7:0]
110
Fx[6]
111
F7[7:0]
111
Fx[7]
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