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參數(shù)資料
| 型號(hào)： | CTMRM |
| 英文描述： | Configurable Timer Module Reference Manual |
| 中文描述： | 配置定時(shí)器模塊參考手冊(cè) |
| 文件頁數(shù)： | 97/164頁 |
| 文件大?。?/td> | 1148K |
| 代理商： | CTMRM |
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CTM
REFERENCE
MOTOROLA
9-3
PULSE WIDTH MODULATION SUBMODULE
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9
64, 128 and 512 (or 3, 6, 12, 24, 48, 96, 192 and 768, if the divide-by-3 option is used in the CPSM
to generate PCLK1).
9.2.3
The PWMSM counter (PWMC)
The 16-bit up-counter in the PWMSM provides the time base for the PWM output signal. The
counter is held in the $0001 state on reset or when the PWMSM is disabled. When the PWMSM
is enabled, the counter begins counting at the rate defined by the clock selection. Each time the
counter matches the contents of the period register, the counter is preset to $0001 and starts to
count from that value. The counter can be read at any time without affecting its value. Writing to
the counter has no effect.
Figure 9-1
Pulse width modulation submodule block diagram
16-bit up counter
PWMC
IL2
IL1
IL0
IARB3
State
sequencer
/ 256 prescaler
(N
count
)
CLK1 CLK0
CLK2
Output
buffer
Set
Submodule bus
Zero
detect
Control register bits
PIN
16-bit comparator
Period register
PWMA2
Next period register
PWMA1
Clock
select
16-bit comparator
Pulse width register
PWMB2
Next pulse width
register PWMB1
Output
flip-flop
Interrupt
control
FLAG
POL
LOAD
EN
Clear
Clear
All zeros
Match
Match
Load
Enable
PCLK1
Output
pin
PWMA
PWMB
F
.
Freescale Semiconductor, Inc.
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PDF描述 |
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