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參數資料
| 型號： | CTMRM |
| 英文描述： | Configurable Timer Module Reference Manual |
| 中文描述： | 配置定時器模塊參考手冊 |
| 文件頁數： | 154/164頁 |
| 文件大?。?/td> | 1148K |
| 代理商： | CTMRM |
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MOTOROLA
ii
CTM
REFERENCE
INDEX
D
counter overflow - continued
pulse accumulator
1-8
PWM
1-9
counter prescaler
4-1
counter prescaler submodule - see CPSM
CPCR — CPSM control register
4-2
CPSM
block diagram
4-1
counter prescaler
4-1
CPCR — CPSM control register
4-2
CPTR — CPSM test register
4-3
freeze
4-2
prescaler division ratio selection
4-3
register map
4-2
CPTR — CPSM test register
4-3
CTM2
B-1
block diagram
B-2
clock input pin - CTM2C
B-1
interrupts
B-3
pin allocation
B-3
time base bus
B-3
vector allocation
B-3
D
daisy-chain priority
3-2
DASM
block diagram
8-1
changing mode
8-3
,
8-4
clock divide ratio
8-11
coherency
8-3
–
8-5
configuring the output buffer
8-15
counter
8-11
DASMA — DASM data register A
8-18
DASMB — DASM data register B
8-18
DASMSIC — DASM status/interrupt/control register
8-14
disable (DIS) mode
8-4
effect of reset on output flip-flop
8-8
flag clearing mechanism
8-14
forcing an output compare
8-16
freeze
8-13
input capture (IC) mode
8-7
input capture example
8-7
input period measurement (IPM) mode
8-5
input pin
8-2
input pin logic level
8-16
interrupts
8-12
minimum pulse width
8-2
modes of operation
8-3
multiple DASMs
8-13
output compare (OCA and OCAB) modes
8-7
output frequencies and resolutions
8-12
output pin
8-2
output port bit operation
8-9
output pulse width modulation (OPWM) mode
8-10
output pulse width modulation example
8-11
pulse width measurement (IPWM) mode
8-4
pulse width measurement example
8-5
DASM - continued
register map
8-13
reserved register
8-13
selecting the input capture edge sensitivity
8-16
selecting the mode of operation
8-17
selecting the time base bus
8-15
single output compare
8-9
single shot output pulse
8-8
single-shot output pulse example
8-9
spurious interrupts
8-3
DASMA — DASM data register A
8-18
DASMB — DASM data register B
8-18
DASMSIC — DASM status/interrupt/control register
8-14
data access
1-3
1-5
DIV23 - bit in CPCR
4-3
double action submodule - see DASM
double buffer
9-4
DRVA, DRVB
bits in FCSMSIC
5-5
bits in MCSMSIC
6-6
duty cycle
1-9
E
EDGEN, EDGEP - bits in MCSMSIC
6-7
EDOUT - bit in SICA
7-9
EDPOL - bit in DASMSIC
8-16
EN - bit in PWMSIC
9-12
enabling/disabling the CTM
2-3
event counter
FCSM
5-2
MCSM
6-3
pulse accumulator
1-8
exception level mask
3-1
exception processing
3-1
F
FCSM
block diagram
5-2
clock sources
5-2
counter
5-1
counter overflow
5-4
driving the time base bus
5-5
effect of reset
5-1
event counter
5-2
FCSMSIC — FCSM status/interrupt/control reg.
5-4
flag clearing
5-4
freeze
5-3
input pin - CTMC
5-2
,
5-5
interrupts
5-2
5-3
maximum external clock frequency
5-3
,
5-6
register map
5-4
reserved registers
5-4
selecting the clock source
5-6
selecting the time base bus
5-3
setting the interrupt level
5-5
TPG
F
.
Freescale Semiconductor, Inc.
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PDF描述 |
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