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參數(shù)資料
| 型號： | CTMRM |
| 英文描述： | Configurable Timer Module Reference Manual |
| 中文描述： | 配置定時器模塊參考手冊 |
| 文件頁數(shù)： | 104/164頁 |
| 文件大?。?/td> | 1148K |
| 代理商： | CTMRM |
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MOTOROLA
9-10
CTM
REFERENCE
PULSE WIDTH MODULATION SUBMODULE
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9
The FLAG bit can only be cleared by software. To clear the flag, the software must first read the bit
(as ‘one’) then write a ‘zero’ to the bit. Writing a one to the FLAG bit has no effect. When the PWM
is disabled the FLAG bit remains in the cleared state.
Note:
The flag clearing mechanism will work only if no flag setting event occurs between the
read and write operations; if a FLAG setting event occurs between the read and write
operations, the FLAG bit will not be cleared.
When the interrupt level set by the interrupt level bit IL[2:0] is not equal to zero, an interrupt request
is generated when the FLAG bit is set. Before returning from the interrupt service routine, the
FLAG bit should be cleared by software to prevent the PWMSM from immediately generating
another interrupt request on the IMB.
IL[2:0] — Interrupt level bits
The three interrupt level bits select the interrupt level of requests made by the PWMSM.
IARB3 — Interrupt arbitration bit 3
The read/write IARB3 bit works in conjunction with the IARB[2:0] field in the BIUSM module
configuration register. Each module that generates interrupt requests on the IMB must have a
unique value in the arbitration field (IARB). This interrupt arbitration identification number is used
to arbitrate for the IMB when modules generate simultaneous interrupts of the same priority (see
Section 3). The IARB3 bit is cleared by reset.
PIN — Output pin status bit
The PIN bit is a status bit that indicates the logic state present on the output pin.
1 (set)
–
Logic one state present on the output pin.
0 (clear) –
Logic zero state present on the output pin.
The software can thus monitor the waveform being created on the output pin. PIN is a read-only
bit; writing to it has no effect.
IL2
0
0
0
0
1
1
1
1
IL1
0
0
1
1
0
0
1
1
IL0
0
1
0
1
0
1
0
1
Selected level
Interrupt disabled
Interrupt level 1 (lowest)
Interrupt level 2
Interrupt level 3
Interrupt level 4
Interrupt level 5
Interrupt level 6
Interrupt level 7 (highest)
F
.
Freescale Semiconductor, Inc.
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