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參數(shù)資料
| 型號(hào)： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊(cè) |
| 文件頁(yè)數(shù)： | 67/482頁(yè) |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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CPU16
REFERENCE MANUAL
INSTRUCTION SET
MOTOROLA
5-23
To make certain that conditions for termination of LPSTOP and WAI are correct, inter-
rupts are not recognized until after the instruction following ANDP, ORP, TAP, and
TDP executes. This prevents interrupt exception processing during the period after the
mask changes but before the following instruction executes.
5.12 Background Mode and Null Operations
Background debug mode is a special CPU16 operating mode that is used for system
development and debugging. Executing BGND when BDM is enabled puts the CPU16
in this mode. For complete information refer to
SECTION 10 DEVELOPMENT SUP-
PORT
.
Null operations are often used to replace other instructions during software debugging.
Replacing conditional branch instructions with BRN, for instance, permits testing a de-
cision-making routine without actually taking the branches.
5.13 Comparison of CPU16 and M68HC11 Instruction Sets
Most M68HC11 instructions are a source-code compatible subset of the CPU16
instruction set. However, certain M68HC11 instructions have been replaced by func-
tionally equivalent CPU16 instructions, and some M68HC11 instructions operate dif-
ferently in the CPU16.
APPENDIX A COMPARISON OF CPU16/M68HC11 CPU
ASSEMBLY LANGUAGE
gives detailed information.
Table 5-33
shows M68HC11 instructions that have either been replaced by CPU16 in-
structions or that operate differently in the CPU16. Replacement instructions are not
identical to M68HC11 instructions; M68HC11 code must be altered to establish proper
preconditions.
All CPU16 instruction cycle counts and execution times differ from those of the
M68HC11.
SECTION 6 INSTRUCTION GLOSSARY
gives information on instruction
cycles. See
SECTION 8 INSTRUCTION TIMING
for information regarding calculation
of instruction cycle times.
Table 5-31 Stop and Wait Summary
Mnemonic
Function
Operation
LPSTOP
Low Power Stop
If S
then STOP
else NOP
WAI
Wait for Interrupt
WAIT
Table 5-32 Background Mode and Null Operations
Mnemonic
BGND
Function
Operation
If BDM enabled
enter BDM;
else, illegal instruction
If 1 = 0, branch
If 1 = 0, branch
—
Enter Background Debugging Mode
BRN
LBRN
NOP
Branch Never
Long Branch Never
Null operation
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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| CQ202-4B2 | TRIAC|200V V(DRM)|4A I(T)RMS|TO-202VAR |
| CQ202-4BS2 | TRIAC|200V V(DRM)|4A I(T)RMS|TO-202VAR |
| CQ202-4D | TRIAC|400V V(DRM)|4A I(T)RMS|TO-202 |
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