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參數(shù)資料
| 型號(hào)： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊(cè) |
| 文件頁(yè)數(shù)： | 462/482頁(yè) |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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MOTOROLA
A-14
COMPARISON OF CPU16/M68HC11 CPU ASSEMBLY LANGUAGE
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CPU16
REFERENCE MANUAL
A.6.4 TXS
The CPU16 subtracts two from XK : IX before the transfer to SK : SP. The M68HC11
CPU subtracts one.
A.6.5 TYS
The CPU16 subtracts two from YK : IY before the transfer to SK : SP. The M68HC11
CPU subtracts one.
A.7 Unimplemented Instructions
A.7.1 TEST
Causes the program counter to be continuously incremented.
A.8 Addressing Mode Differences
A.8.1 Extended Addressing Mode
In M68HC11 CPU extended addressing mode, the effective address of the instruction
appears explicitly in the two bytes following the opcode. In CPU16 extended address-
ing mode, the effective address is formed by concatenating the EK field and the 16-bit
byte address. A 20-bit extended mode (EXT20) is used only by the JMP and JSR
instructions. These instructions contain a 20-bit effective address that is zero-
extended to 24 bits to give the instruction an even number of bytes.
A.8.2 Indexed Addressing Mode
M68HC11 CPU indexed addressing mode forms the effective address by adding the
fixed, 8-bit, unsigned offset to the index register. In CPU16 indexed addressing mode,
a fixed 16-bit offset can be used. Note however, that the 16-bit offset is signed and can
give a negative offset from the index register. An 8-bit unsigned mode is still available
on the CPU16. A 20-bit indexed mode is used for JMP and JSR instructions. In 20-bit
modes, a 20-bit signed offset is added to the value contained in an index register.
A.8.3 Post-Modified Index Addressing Mode
Post-modified index mode is used with the CPU16 MOVB and MOVW instructions. A
signed 8-bit offset is added to index register X after the effective address formed by
XK : IX is used.
A.8.4 Use of CPU16 Indexed Mode to Replace M68HC11 CPU Direct Mode
In M68HC11 systems, direct addressing mode can be used to perform rapid accesses
to RAM or I/O mapped into bank 0 ($0000 to $00FF), but the CPU16 uses the first 512
bytes of bank 0 for exception vectors. To provide an enhanced replacement for direct
mode, the ZK field and index register Z have been assigned reset initialization vectors.
After ZK : IZ have been initialized, indexed addressing provides rapid access to useful
data structures.
F
Freescale Semiconductor, Inc.
n
.
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PDF描述 |
|---|---|
| CQ202-4M | 4.0 AMP TRIAC 600 THRU 800 VOLTS |
| CQ202-4B | TRIAC|200V V(DRM)|4A I(T)RMS|TO-202 |
| CQ202-4B2 | TRIAC|200V V(DRM)|4A I(T)RMS|TO-202VAR |
| CQ202-4BS2 | TRIAC|200V V(DRM)|4A I(T)RMS|TO-202VAR |
| CQ202-4D | TRIAC|400V V(DRM)|4A I(T)RMS|TO-202 |
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