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參數(shù)資料
| 型號(hào)： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊(cè) |
| 文件頁(yè)數(shù)： | 51/482頁(yè) |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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CPU16
REFERENCE MANUAL
INSTRUCTION SET
MOTOROLA
5-7
5.3.5 Decrement and Increment Instructions
These instructions are optimized 8- and 16-bit addition and subtraction operations.
They are generally used to implement counters. Because they do not affect the carry
bit in the CCR, they are particularly well suited for loop counters in multiple-precision
computation routines.
5.3.6 Clear, Complement, and Negate Instructions
Each of these instructions performs a specific binary operation on a value in an accu-
mulator or in memory. Clear operations set the value to zero, complement operations
replace the value with its one’s complement, and negate operations replace the value
with its two’s complement.
Table 5-13 Decrement and Increment Summary
Mnemonic
DEC
DECA
DECB
DECW
INC
INCA
INCB
INCW
Function
Operation
(M) – $01
M
(A) – $01
A
(B) – $01
B
Decrement Memory
Decrement A
Decrement B
Decrement Memory Word
Increment Memory
Increment A
Increment B
Increment Memory Word
(M : M + 1) – $0001
M : M + 1
(M) + $01
M
(A) + $01
A
(B) + $01
B
(M : M + 1) + $0001
M : M + 1
Table 5-14 Clear, Complement, and Negate Summary
Mnemonic
CLR
CLRA
CLRB
CLRD
CLRE
CLRW
COM
COMA
COMB
COMD
COME
COMW
NEG
NEGA
NEGB
NEGD
NEGE
NEGW
Function
Clear Memory
Clear A
Clear B
Clear D
Clear E
Clear Memory Word
One’s Complement Byte
One’s Complement A
One’s Complement B
One’s Complement D
One’s Complement E
One’s Complement Word
Two’s Complement Byte
Two’s Complement A
Two’s Complement B
Two’s Complement D
Two’s Complement E
Two’s Complement Word
Operation
$00
M
$00
A
$00
B
$0000
D
$0000
E
$0000
M : M + 1
$FF – (M)
M
$FF – (A)
A
$FF – (B)
B
$FFFF – (D)
D
$FFFF – (E)
E
$FFFF – M : M + 1
M : M + 1
$00 – (M)
M
$00 – (A)
A
$00 – (B)
B
$0000 – (D)
D
$0000 – (E)
E
$0000 – (M : M + 1)
M : M + 1
F
Freescale Semiconductor, Inc.
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n
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