- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄382908 > CPU16RM M68HC16 Family CPU16 Reference Manual PDF資料下載
參數(shù)資料
| 型號(hào)： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊(cè) |
| 文件頁(yè)數(shù)： | 392/482頁(yè) |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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MOTOROLA
9-10
EXCEPTION PROCESSING
CPU16
REFERENCE MANUAL
Unlike all other exceptions, RESET occurs at the end of a bus cycle, and not at an in-
struction boundary. Any processing in progress at the time RESET occurs will be
aborted, and cannot be recovered.
The following events take place when MSTRST is asserted.
A. Instruction execution is aborted.
B. The condition code register is initialized.
1. The IP field is set to $7, disabling all interrupts below priority 7.
2. The S bit is set, disabling LPSTOP mode.
3. The SM bit is cleared, disabling MAC saturation mode.
C. The K register is cleared.
It is important to be aware that all CCR bits that are not initialized are not affected by
reset. However, out of power-on reset, these bits will be indeterminate.
The following events take place when MSTRST is negated after assertion.
A. The CPU16 samples the BKPT input.
B. The CPU16 fetches RESET vectors in the following order:
1. Initial ZK, SK, and PK extension field values.
2. Initial PC.
3. Initial SP.
4. Initial IZ value.
C. The CPU16 begins fetching instructions pointed to by the initial PK : PC.
The CPU16 samples the BKPT inputs to determine whether to enable background de-
bugging mode.
If either BKPT input is at logic level zero when sampled, an internal BDM flag is set,
and the CPU16 enters BDM whenever either BKPT input is subsequently asserted.
If both BKPT inputs are at logic level one when sampled, normal BKPT exception pro-
cessing begins whenever either BKPT input is subsequently asserted.
When BDM is enabled, the CPU16 will enter debugging mode whenever the condi-
tions for breakpoint are met. See
9.7.1.3 Breakpoint Exception (BKPT)
for more in-
formation.
ZK : IZ are initialized for use as a direct bank pointer. Using the pointer, any location
in memory can be accessed out of reset by means of indexed addressing. This capa-
bility maintains compatibility with MC68HC11 routines that use direct addressing
mode.
Only essential RESET tasks are performed during exception processing. Other initial-
ization tasks must be accomplished by the exception handler routine.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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