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參數(shù)資料
| 型號： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊 |
| 文件頁數(shù)： | 355/482頁 |
| 文件大小： | 2417K |
| 代理商： | CPU16RM |
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CPU16
REFERENCE MANUAL
INSTRUCTION PROCESS
MOTOROLA
7-1
SECTION 7 INSTRUCTION PROCESS
This section explains how the CPU16 fetches and executes instructions. Topics in-
clude instruction format, pipelining, and changes in program flow. Other forms of the
instruction process are covered in
SECTION 9 EXCEPTION PROCESSING
and
SEC-
TION 11 DIGITAL SIGNAL PROCESSING
. See
SECTION 5 INSTRUCTION SET
and
SECTION 6 INSTRUCTION GLOSSARY
for
detailed information concerning in-
structions.
7.1 Instruction Format
CPU16 instructions consist of an 8-bit opcode, which may be preceded by an 8-bit pre-
byte and/or followed by one or more operands.
Opcodes are mapped in four 256-instruction pages. Page 0 opcodes stand alone, but
page 1, 2, and 3 opcodes are pointed to by a prebyte code on page 0. The prebytes
are $17 (page 1), $27 (page 2), and $37 (page 3).
Operands can be four bits, eight bits, or sixteen bits in length. However, because the
CPU16 fetches 16-bit instruction words from even byte boundaries, each instruction
must contain an even number of bytes.
Operands are organized as bytes, words, or a combination of bytes and words. Four-
bit operands are either zero-extended to eight bits, or packed two to a byte. The largest
instructions are six bytes in length. Size, order, and function of operands are evaluated
when an instruction is decoded.
A page 0 opcode and an 8-bit operand can be fetched simultaneously. Instructions that
use 8-bit indexed, immediate, and relative addressing modes have this form — code
written with these instructions is very compact.
Table 7-1
shows basic CPU16 instruction formats.
Table 7-2
,
Table 7-3
,
Table 7-4
,
and
Table 7-5
show instructions in opcode order by page.
F
Freescale Semiconductor, Inc.
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Go to: www.freescale.com
n
.
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