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參數(shù)資料
| 型號： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊 |
| 文件頁數(shù)： | 455/482頁 |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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CPU16
REFERENCE MANUAL
COMPARISON OF CPU16/M68HC11 CPU ASSEMBLY LANGUAGE
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MOTOROLA
A-7
A.3.4.5 Interrupt Priority
There are eight levels of interrupt priority. All interrupts with priorities less than seven
can be masked by writing to the CCR interrupt priority (IP) field.
The IP field consists of three bits (CCR[7:5]). Binary values %000 to %111 provide
eight priority masks. Masks prevent an interrupt request of a priority less than or equal
to the mask value (except for NMI) from being recognized and processed. When IP
contains %000, no interrupt is masked.
A.3.5 Stack Frame
When a change of flow occurs, the contents of the program counter and condition code
register are stacked at the location pointed to by SK : SP.
Figure A-5
shows the stack
frame. Unless it is altered during exception processing, the stacked PK : PC value is
the address of the next instruction in the current instruction stream, plus $0006. RTS
restores only stacked PK : PC – 2, while RTI restores PK : PC – 6 and the CCR.
Figure A-5 CPU16 Stack Frame Format
A.4 Functionally Equivalent Instructions
A.4.1 BHS
The CPU16 uses only the BCC mnemonic. BHS is used in the M68HC11 CPU instruc-
tion set to differentiate a branch based on a comparison of unsigned numbers from a
branch based on operations that clear the carry bit.
A.4.2 BLO
The CPU16 uses only the BCS mnemonic. BLO is used in the M68HC11 CPU instruc-
tion set to differentiate a branch based on a comparison of unsigned numbers from a
branch based on operations that set the carry bit.
A.4.3 CLC
The CLC instruction has been replaced by ANDP. ANDP performs AND between the
content of the condition code register and an unsigned immediate operand, then
replaces the content of the CCR with the result. The PK extension field (CCR[0:3]) is
not affected.
The following code can be used to clear the C bit in the CCR:
ANDP #$FEFF
The ANDP instruction can clear the entire CCR, except for the PK extension field, at
once.
Low Address
SP After Stacking
Condition Code Register
Program Counter
High Address
SP Before Stacking
F
Freescale Semiconductor, Inc.
n
.
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