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參數(shù)資料
| 型號： | CPU16RM |
| 英文描述： | M68HC16 Family CPU16 Reference Manual |
| 中文描述： | M68HC16家庭CPU16參考手冊 |
| 文件頁數(shù)： | 397/482頁 |
| 文件大?。?/td> | 2417K |
| 代理商： | CPU16RM |
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CPU16
REFERENCE MANUAL
EXCEPTION PROCESSING
MOTOROLA
9-15
9.7.2.2 Division By Zero
This exception is a part of the instruction definition for division instructions EDIV and
EDIVS. If the divisor is zero when either is executing, the exception is taken. In both
cases, exception processing follows the normal sequence, except that the PK : PC val-
ue is adjusted before it is stacked.
9.7.2.3 BGND Instruction
Execution of the BGND instruction differs depending upon whether background de-
bugging mode has been enabled. See
9.7.1.3 Breakpoint Exception (BKPT)
for in-
formation concerning enabling BDM.
1. If BDM has been enabled, BDM is entered. See
SECTION 10 DEVELOPMENT
SUPPORT
for more information concerning BDM.
2. If BDM is not enabled, an illegal instruction exception occurs. In this case, ex-
ception processing follows the normal sequence, except that the PK : PC value
is adjusted before it is stacked.
9.7.2.4 SWI Instruction
The software interrupt instruction initiates synchronous exception processing. Excep-
tion processing for SWI follows the normal sequence, except that the PK : PC value is
adjusted before it is stacked.
9.8 Return from Interrupt (RTI)
RTI must be the last instruction in all exception handlers except for the RESET han-
dler. RTI pulls the exception stack frame and restores processor state. Normal pro-
gram flow resumes at the address of the instruction that follows the last instruction
executed before exception processing began. RTI is not used in the RESET handler
because RESET initializes the stack pointer and does not create a stack frame.
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
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