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參數(shù)資料
| 型號(hào)： | celeron 700 |
| 廠商： | Intel Corp. |
| 英文描述： | Intel Celeron Processor Up To 700 MHz(頻率達(dá)700MHz的INTEL Celeron 處理器) |
| 中文描述： | 英特爾賽揚(yáng)處理器高達(dá)700兆赫（頻率達(dá)700MHz的英特爾賽揚(yáng)處理器的） |
| 文件頁數(shù)： | 46/118頁 |
| 文件大?。?/td> | 990K |
| 代理商： | CELERON 700 |
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46
Datasheet
Intel
Celeron Processor up to 700 MHz
NOTES:
1. Unless otherwise noted, all specifications in this table apply to all Intel
Celeron processor frequencies.
2. This is the Intel Celeron processor system bus clock overshoot and undershoot measurement guideline.
3. The rising and falling edge ringback voltage guideline is the minimum (rising) or maximum (falling) absolute
voltage the BCLK signal may dip back to after passing the V
IH
(rising) or V
IL
(falling) voltage limits. This
guideline is an absolute value.
4. The BCLK at the processor edge fingers may have a dip or ledge midway on the rising or falling edge. The
midpoint voltage level of this ledge should be within the range of the guideline.
5. The ledge (V7) is allowed to have peak-to-peak oscillation as given in the guideline.
Table 26. BCLK Signal Quality Guidelines for Edge Finger Measurement
(for the S.E.P. Package)
1
T# Parameter
Min
Nom
Max
Unit
Figure
Notes
V1’: BCLK V
IL
0.5
V
12
V2’: BCLK V
IH
2.0
V
12
V3’: V
IN
Absolute Voltage Range
–0.5
3.3
V
12
2
V4’: Rising Edge Ringback
2.0
V
12
3
V5’: Falling Edge Ringback
0.5
V
12
3
At Ledge Midpoint
4
Peak-to-Peak
5
V6’: T
line
Ledge Voltage
1.0
1.7
V
12
V7’: T
line
Ledge Oscillation
0.2
V
12
Figure 12. BCLK, TCK, PICCLK Generic Clock Waveform at the Processor Edge Fingers
T3
V3
V5
V3
V2
V1
V7
V6
T6
T4
T5
V4
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