參數(shù)資料
型號： OR3LP26B
英文描述： Field-Programmable System Chip (FPSC) Embedded Master/Target PCI Interface
中文描述： 現(xiàn)場可編程系統(tǒng)芯片（促進文化基金）嵌入式主/目標PCI接口
文件頁數(shù)： 30/184頁
文件大小： 5590K
代理商： OR3LP26B
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ORCAOR3LP26B FPSC
Embedded Master/Target PCI Interface
Data Sheet
March 2000
30
L Lucent Technologies Inc.
PCI Bus Core Detailed Description
Dual Port
(continued)
Table 10. Bit Definitions on FPGA/PCI Core Interface
* Command Codes (codes correspond to PCI bus command codes):
0000 Not Used (interrupt acknowledge not implemented)
0001 Not Used (special cycle not implemented)
0010 I/O Read
0011 I/O Write
0100 Reserved (per PCI specification)
0101 Reserved (per PCI specification)
0110 Memory Read
0111 Memory Write
1000 Reserved (per PCI specification)
1001 Reserved (per PCI specification)
1010 Configuration Read
1011 Configuration Write
1100 Memory Read Multiple
1101 Not Used (dual address operation is indicated via separate signal)
1110 Memory Read Line
1111 Memory Write and Invalidate
Bits
Name
Description
A. Dual-Port Master Write, Command and Address
datafmfpgax[7:3]
datafmfpgax[2]
datafmfpgax[1:0]
datafmfpga[63:32]
mstatecntr = 0
—
DA
—
Unused
Dual address indicator (active-high)
Unused
Address words 3 and 2 (if DA = 1; else must set
all bits to 0s)
Address words 1 and 0
Master command opcode*
A3 & A2
datafmfpga[31:0]
mcmd[3:0]
B. Dual-Port Master Write, Data
datafmfpgax[7:0]
datafmfpga[63:0]
C. Dual-Port Master Read (Burst Length Cycle)
datafmfpgax[7:3]
datafmfpgax[2]
datafmfpgax[1:0]
datafmfpga[63:56]
datafmfpga[55:50]
datafmfpga[49:32]
datafmfpga[31:0]
A1 & A0
mcmd
mstatecntr = 4
BE7—BE0
D7—D0
Byte enables (active-low)
Data bytes 7 to 0
mstatecntr = 0
—
DA
—
Unused
Dual address indicator (active-high)
Unused
Byte enables (active-low)
Unused
Burst length (in Quadwords)
Address words 1 and 0 (set to all 0s if 64-bit
address required—A1 & A0 supplied in next
cycle)
Master command opcode*
mrd_benn
—
BL
A1 & A0
mcmd[3:0]
mcmd
D. Dual-Port Master Read (64-Bit Address Cycle)
datafmfpgax[7:0]
datafmfpga[63:32]
datafmfpga[31:0]
mcmd[3:0]
E. Dual-Port Master Read, Data
datatofpgax[7:0]
datatofpga[63:0]
mstatecntr = 1
—
Unused
A3 & A2
A1 & A0
—
Address words 3 and 2
Address words 1 and 0
Unused
mstatecntr = 4
—
Unused
D7—D0
Data bytes 7 to 0
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