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參數(shù)資料
| 型號： | OR3LP26B |
| 英文描述： | Field-Programmable System Chip (FPSC) Embedded Master/Target PCI Interface |
| 中文描述： | 現(xiàn)場可編程系統(tǒng)芯片（促進文化基金）嵌入式主/目標PCI接口 |
| 文件頁數(shù)： | 153/184頁 |
| 文件大?。?/td> | 5590K |
| 代理商： | OR3LP26B |
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Lucent Technologies Inc.
Lucent Technologies Inc.
153
Data Sheet
March 2000
ORCAOR3LP26B FPSC
Embedded Master/Target PCI Interface
Pin Information
(continued)
Table 68.
FPGA Common-Function Pin Descriptions
(continued)
* The ORCA Series 3 FPGA data sheet contains more information on how to control these signals during start-up. The timing of DONE release
is controlled by one set of bit stream options, and the timing of the simultaneous release of all other configuration pins (and the activation of all
user I/Os) is controlled by a second set of options.
Symbol
I/O
Description
Special-Purpose Pins
(continued)
MPI_IRQ
O
I/O
O
I/O
O
MPI
active-low interrupt request output.
If the MPI is not in use, this is a user-programmable I/O.
PowerPCmode
MPI
burst inhibit output.
If the MPI is not in use, this is a user-programmable I/O.
In PowerPC mode
MPI
operation, this is the active-high transfer acknowledge (
TA
)
output. For i960
MPI
operation, it is the active-low ready/record (
RDYRCV
) output.
If the MPI is not in use, this is a user-programmable I/O.
In PowerPCmode
MPI
operation, this is the active-low write/ active-high read control
signals. For i960operation, it is the active-high write/active-low read control signal.
If the MPI is not in use, this is a user-programmable I/O.
This is the clock used for the synchronous
MPI
interface. For PowerPC it is the CLK-
OUT signal. For i960 it is the system clock that is chosen for the i960external bus
interface.
If the MPI is not in use, this is a user-programmable I/O.
For PowerPCoperation, these are the PowerPCaddress inputs. The address bit
mapping (in PowerPCFPGA notation) is A[31]/A[0], A[30]/A[1], A[29]/A[2], A[28]/
A[3], A[27]/A[4]. Note that A[27]/A[4] is the MSB of the address. The A[4:2] inputs
are not used in i960
MPI
mode.
If the MPI is not in use, this is a user-programmable I/O.
For i960 operation,
MPI_BE[1:0]
provide the i960byte enable signals,
BE[1:0]
, that are
used as address bits A[1:0] in i960 byte-wide operation.
During Master parallel, peripheral, and slave parallel configuration modes, D[7:0]
receive configuration data, and each pin has a pull-up enabled. During serial config-
uration modes, D0 is the DIN input. D[7:0] are also the data pins for PowerPCmicro-
processor mode and the address/data pins for i960microprocessor mode.
After configuration, the pins are user-programmable I/O pins.*
During slave serial or Master serial configuration modes, DIN accepts serial configu-
ration data synchronous with CCLK. During parallel configuration modes, DIN is the
D0 input. During configuration, a pull-up is enabled.
After configuration, this pin is a user-programmable I/O pin.*
During configuration, DOUT is the serial data output that can drive the DIN of daisy-
chained slave LCA devices. Data out on DOUT changes on the falling edge of
CCLK.
After configuration, DOUT is a user-programmable I/O pin.*
MPI_BI
MPI_ACK
MPI_RW
I
I/O
I
MPI_CLK
I/O
I
A[4:0]
I/O
I
A[1:0]/
MPI_BE[1:0]
D[7:0]
I
I/O
I
DIN
I/O
O
DOUT
I/O
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