參數(shù)資料
型號(hào)： OR3LP26B
英文描述： Field-Programmable System Chip (FPSC) Embedded Master/Target PCI Interface
中文描述： 現(xiàn)場(chǎng)可編程系統(tǒng)芯片（促進(jìn)文化基金）嵌入式主/目標(biāo)PCI接口
文件頁(yè)數(shù)： 157/184頁(yè)
文件大?。?/td> 5590K
代理商： OR3LP26B
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Lucent Technologies Inc.
Lucent Technologies Inc.
157
Data Sheet
March 2000
ORCAOR3LP26B FPSC
Embedded Master/Target PCI Interface
Pin Information
(continued)
Table 70.
Pinout Information
(continued)
* These pads are connected to a power plane in the package rather than to a particular pin. The entry's location in the table indicates the posi-
tion of the power pad relative to nearby signal pads.
Pins marked No Connect must be left unconnected.
These pins are connected to a power plane in the package rather than to a particular pad.
OR3LP26B Pad
Function
PBGA 352
PBGAM 680
PL15B
PL15A
V
SS
PL16D
PL16C
PL16B
PL16A
PL17D
PL17C
PL17B
PL17A
V
SS
PL18D
PL18C
PL18B
PL18A
PL19D
PL19C
PL19B
PL19A
V
DD
PL20D
PL20C
PL20B
V
DD
2
PL20A
PL21D
PL21C
PL21B
PL21A
V
SS
PL22D
PL22C
PL22B
PL22A
PL23D
PL23C
I/O
P1
N3
V
SS
*
R2
—
—
P3
R1
—
—
T2
V
SS
*
R3
—
—
T1
R4
—
—
U2
V
DD
*
T3
U1
U4
—
V2
U3
V1
W2
W1
V
SS
*
V3
Y2
—
—
W4
—
V2
V3
V
SS
*
V4
V5
W1
W2
W4
W5
Y1
Y2
V
SS
*
Y4
Y5
AA1
AA2
AA3
AA4
AA5
AB1
V
DD
*
AB2
AB3
—
V
DD
2
AB4
AB5
AC1
AC2
AC4
V
SS
*
AC5
AD1
AD2
AD4
AD5
AE1
I/O-MPI_RW
V
SS
I/O-MPI_ACK
I/O
I/O
I/O
I/O
I/O
I/O
I/O-MPI_BI
V
SS
I/O
I/O
I/O
I/O-SECKLL
No Connect
No Connect
No Connect
I/O-MPI_IRQ
V
DD
No Connect
No Connect
No Connect
V
DD
2
No Connect
V
DD
V
SS
V
SS
intan
V
SS
rstn
gntn
No Connect
No Connect
reqn
No Connect
相關(guān)PDF資料
PDF描述
OR3TP12-6BA256 Single 2.3V 10 MHz OP w/ CS, I temp, -40C to +85C, 8-TSSOP, T/R
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OR3TP12-6BA352 Quad 2.3V 10 MHz OP, I temp, -40C to +85C, 14-PDIP, TUBE
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參數(shù)描述
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