參數(shù)資料
型號： OR3LP26B
英文描述： Field-Programmable System Chip (FPSC) Embedded Master/Target PCI Interface
中文描述： 現(xiàn)場可編程系統(tǒng)芯片（促進文化基金）嵌入式主/目標PCI接口
文件頁數(shù)： 156/184頁
文件大?。?/td> 5590K
代理商： OR3LP26B
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ORCAOR3LP26B FPSC
Embedded Master/Target PCI Interface
Data Sheet
March 2000
156
L Lucent Technologies Inc.
Pin Information
(continued)
Table 70.
Pinout Information
(continued)
* These pads are connected to a power plane in the package rather than to a particular pin. The entry's location in the table indicates the posi-
tion of the power pad relative to nearby signal pads.
Pins marked No Connect must be left unconnected.
These pins are connected to a power plane in the package rather than to a particular pad.
OR3LP26B Pad
Function
PBGA 352
PBGAM 680
PL8C
PL8B
PL8A
PL9D
PL9C
PL9B
PL9A
V
DD
PL10D
V
DD
2
PL10C
PL10B
PL10A
PL11D
PL11C
PL11B
PL11A
V
SS
PL12D
PL12C
PL12B
PL12A
V
DD
2
PL13D
PL13C
PL13B
PL13A
V
SS
PECKL
PL14D
PL14C
PL14B
PL14A
V
DD
PL15D
PL15C
V
DD
2
I/O
I/O
J4
H1
H3
J2
J1
K2
J3
V
DD
*
K1
—
—
—
K4
L2
—
—
K3
V
SS
*
L1
—
—
M2
—
M1
—
—
L3
V
SS
*
N2
—
M4
N1
M3
V
DD
*
P2
—
P4
M4
M2
M1
N5
N4
N3
N2
V
DD
*
—
V
DD
2
N1
P5
P4
P3
P2
P1
R5
V
SS
*
R4
R2
R1
—
V
DD
2
T5
T4
T2
T1
V
SS
*
U5
—
U3
U2
U1
V
DD
*
V1
—
V
DD
2
I/O-A2
I/O
I/O
I/O
I/O-A3
V
DD
I/O
V
DD
2
I/O
I/O
I/O
I/O
I/O
I/O
I/O-A4
V
SS
I/O
I/O
I/O
I/O
V
DD
2
I/O
I/O
I/O
I/O
V
SS
I-ECKL
—
I/O
I/O
I/O-MPI_CLK
V
DD
I/O
——
V
DD
2
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PDF描述
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參數(shù)描述
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