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  • 參數(shù)資料
    型號(hào)： COLDFIRE2UM
    英文描述： Version 2/2M ColdFire Core Processor User＇s Manual
    中文描述： 版本2/2M ColdFire內(nèi)核的處理器用戶(hù)手冊(cè)
    文件頁(yè)數(shù)： 248/253頁(yè)
    文件大?。?/td> 1762K
    代理商： COLDFIRE2UM
    第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)當(dāng)前第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)
    Index-4
    ColdFire2/2M User’s Manual
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    MOTOROLA
    integrated processors
    1-2
    interrupt acknowledge
    diagram
    3-24
    ,
    3-26
    flowchart
    3-23
    interrupt acknowledge access
    3-5
    interrupt acknowledge bus cycle
    3-22
    interrupt acknowledge mode
    2-3
    ,
    2-5
    ,
    2-6
    ,
    3-1
    ,
    3-3
    ,
    3-4
    ,
    3-22
    miss fetch algorithm
    5-4
    ,
    5-8
    physical organization
    5-4
    programming model
    5-6
    registers
    cache control (CACR)
    5-6
    ,
    A-3
    reset
    5-6
    signals
    5-1
    address bus (ICH_ADDR)
    2-7
    ,
    5-2
    cache tag output bus (ICHT_DO)
    2-8
    ,
    5-3
    data chip select (ICHD_CSB)
    2-7
    ,
    5-2
    data input bus (ICHD_DI)
    2-7
    ,
    5-2
    data output bus (ICHD_DO)
    2-7
    ,
    5-2
    data read/write (ICHD_RWB)
    2-7
    ,
    5-3
    data strobe (ICHD_ST)
    2-7
    ,
    5-2
    size(ICH_SZ)
    2-8
    ,
    5-3
    tag chip select (ICHT_CSB)
    2-8
    ,
    5-3
    tag input bus (ICHT_DI)
    2-8
    ,
    5-3
    tag read/write (ICHT_RWB)
    2-9
    ,
    5-4
    tag strobe (ICHT_ST)
    2-9
    ,
    5-4
    tag RAM testing
    8-3
    write protection
    5-8
    See also
    registers, signals
    instruction execution timing
    9-1
    assumptions
    9-1
    branch
    9-8
    MAC
    9-8
    miscellaneous
    9-7
    MOVE
    9-2
    one operand
    9-4
    two operand
    9-5
    instruction set summary
    1-19
    ,
    6-5
    integer data formats
    1-16
    integer programming model
    1-11
    integrated memories
    5-1
    testing
    8-1
    integrated memory test signals
    2-12
    interrupt priority level (IPLB)
    2-6
    ,
    4-10
    interrupts
    4-10
    autovectored
    4-12
    debug
    4-10
    ,
    7-26
    level seven
    4-11
    spurious
    3-27
    ,
    4-12
    uninitialized
    4-12
    invalidating cache entries
    5-5
    ,
    5-7
    IPLB
    2-6
    ,
    4-10
    K
    KTA mode
    8-9
    L
    level seven interrupts
    4-11
    line access patterns
    3-11
    line fills
    5-4
    line read transfer
    diagram
    3-13
    flowchart
    3-12
    line write transfer
    diagram
    3-16
    ,
    3-17
    flowchart
    3-15
    M
    MAC
    9-8
    ,
    B-2
    MAC Status Register (MACSR)
    6-2
    MAC status register (MACSR)
    1-14
    MAC unit
    6-1
    enhanced integer multiply instructions
    B-1
    instruction set summary
    6-5
    instruction timing
    9-8
    introduction
    6-1
    new MAC instructions
    B-1
    new register instructions
    B-12
    overflow mode
    6-3
    ,
    6-4
    programming model
    1-13
    ,
    6-2
    registers
    ACC
    6-2
    MACSR
    6-2
    MASK
    6-3
    saturation mode
    6-3
    ,
    6-4
    shifting
    6-4
    MACL
    9-8
    ,
    B-4
    MACSR
    1-14
    ,
    6-2
    F
    Freescale Semiconductor, Inc.
    n
    .
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