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參數(shù)資料
| 型號： | COLDFIRE2UM |
| 英文描述： | Version 2/2M ColdFire Core Processor User＇s Manual |
| 中文描述： | 版本2/2M ColdFire內(nèi)核的處理器用戶手冊 |
| 文件頁數(shù)： | 134/253頁 |
| 文件大?。?/td> | 1762K |
| 代理商： | COLDFIRE2UM |
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Multiply-Accumulate Unit
MOTOROLA
ColdFire2/2M User’s Manual
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Go to: www.freescale.com
6-3
Field Definitions:
OMC[7]–Overflow Mode Control
0 = normal mode
1 = saturation mode
This bit is used to enable or disable saturation mode on overflow. This bit is cleared by
system reset. Refer to
Section 6.4 Overflow Mode
.
S/U[6]–Signed/Unsigned Operations
The S/U bit defines the type of multiply operations that are performed.
0 = signed numbers
1 = unsigned numbers
This bit is cleared by system reset.
N[3]–Negative
This bit is set if the most significant bit of the result is set, cleared otherwise. This bit is
affected only by MAC operations. The MULS and MULU instructions do not change this
value.
Z[2]–Zero
This bit is set if the result equals zero, otherwise, it is cleared. This bit is affected only by
MAC operations. MULS and MULU instructions do not change this value.
V[1]–Overflow
This bit is set if an arithmetic overflow occurs implying that the result cannot be represented
in 32 bits. Once set, this bit remains set until the ACC register is loaded with a new value
using the MOVE to ACC instruction, or the MACSR is explicitly loaded using the MOVE to
MACSR instruction. The MULS and MULU instructions do not change this value.
C[0]–Carry
This field is always zero and is reserved for future use.
6.2.3 Mask Register (MASK)
This is a 16-bit special purpose register used to mask the lower 16 address bits during MAC
load operations. The field definition follows.
BITS
7
6
5
4
3
2
1
0
FIELD
OMC
S/U
-
-
N
Z
V
C
RESET
0
0
0
0
-
-
-
0
R/W
R/W
R/W
R
R
R/W
R/W
R/W
R
MAC Status Register (MACSR)
F
Freescale Semiconductor, Inc.
n
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| COLDFIRE2UMAD | Version 2/2M ColdFire Core Processor User＇s Manual Addendum |
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| COM2502P | UART |
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參數(shù)描述 |
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