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參數(shù)資料
| 型號： | COLDFIRE2UM |
| 英文描述： | Version 2/2M ColdFire Core Processor User＇s Manual |
| 中文描述： | 版本2/2M ColdFire內(nèi)核的處理器用戶手冊 |
| 文件頁數(shù)： | 19/253頁 |
| 文件大小： | 1762K |
| 代理商： | COLDFIRE2UM |
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MOTOROLA
ColdFire2/2M User’s Manual
For More Information On This Product,
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LIST OF TABLES
Table
Number
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Title
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5-3
5-4
5-5
5-6
5-7
MOVEC Register Map.....................................................................................1-14
Integer Data Formats......................................................................................1-16
Effective Addressing Modes and Categories..................................................1-19
Notational Conventions...................................................................................1-19
Instruction Set Summary.................................................................................1-21
Signal Summary................................................................................................2-2
Master Arbiter Control Encoding.......................................................................2-4
Master Bus Transfer Size Encoding..................................................................2-5
Master Bus Transfer Modifier Encoding............................................................2-5
Master Bus Transfer Type Encoding.................................................................2-6
Interrupt Levels and Mask Values.....................................................................2-7
Cache Configuration Encoding .........................................................................2-8
Valid Tag RAM Data Signals.............................................................................2-8
Valid ROM Address Bits....................................................................................2-9
ROM Configuration Encoding .........................................................................2-10
Valid SRAM Address Bits................................................................................2-10
SRAM Configuration Encoding .......................................................................2-11
Processor Status Encoding.............................................................................2-12
Master Arbiter Control Encoding.......................................................................3-1
Master Bus Transfer Size Encoding..................................................................3-2
Master Bus Transfer Modifier Encoding............................................................3-3
Master Bus Transfer Type Encoding.................................................................3-4
MRDATA Requirements for Read Transfers.....................................................3-5
MWDATA Bus Requirements for Write Transfers.............................................3-6
Allowable Line Access Patterns......................................................................3-11
Memory Alignment Cycles ..............................................................................3-19
MTAB and MTEAB Assertion Results.............................................................3-27
Stack Pointer Alignment....................................................................................4-5
Exception Vector Assignments .........................................................................4-5
Exception Priority Groups .................................................................................4-6
Interrupt Levels and Mask Values...................................................................4-11
Cache Configuration Encoding .........................................................................5-3
Valid Tag RAM Data Signals.............................................................................5-3
Initial Fetch Offset and CLNF Bits.....................................................................5-5
Cache Line Fill Encoding ..................................................................................5-8
Valid ROM Address Bits..................................................................................5-11
ROM Configuration Encoding .........................................................................5-12
Valid ROM Base Address Bits ........................................................................5-13
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料 |
PDF描述 |
|---|---|
| COLDFIRE2UMAD | Version 2/2M ColdFire Core Processor User＇s Manual Addendum |
| COLDFIRE3UM | Version 3 ColdFire Core User＇s Manual |
| COM150A | 100V Single N-Channel Hi-Rel MOSFET in a TO-254AA package |
| COM2017P | UART |
| COM2502P | UART |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| COLDFIRE2UMAD | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Version 2/2M ColdFire Core Processor User＇s Manual Addendum |
| COLDFIRE3UM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Version 3 ColdFire Core User＇s Manual |
| COLD-PACK | 制造商:NTE Electronics 功能描述: |
| COLDS/002 | 制造商:Farnell / Duratool 功能描述:JOBBER DRILL SET 1.0-13.0X0.5MM |
| COLINKEX | 制造商:Embest Info&Tech Co Ltd 功能描述:ADAPTER DEBUG SW/JTAG 制造商:EMBEST 功能描述:ADAPTER, DEBUG, SW/JTAG 制造商:EMBEST 功能描述:DEBUGGER, LPC13XX; Silicon Family Name:LPC13xx; Core Architecture:ARM; Core Sub-Architecture:Cortex-M3; IC Product Type:Debugger; Features:Support Cortex M0 and Cortex M3 Devices, Support Software & JTAG Debugging ;RoHS Compliant: Yes |
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