參數(shù)資料
型號： COLDFIRE2UM
英文描述： Version 2/2M ColdFire Core Processor User＇s Manual
中文描述： 版本2/2M ColdFire內核的處理器用戶手冊
文件頁數(shù)： 197/253頁
文件大小： 1762K
代理商： COLDFIRE2UM
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Test Operation
8-18
ColdFire2/2M User’s Manual
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MOTOROLA
Figure 8-8. I-Cache Data Write/Read
Clock 1 (C1)
On the first clock cycle , A1 (data RAM address) should be driven onto TEST_ADDR[14:2]
and TEST_IDATA_WRT should be asserted.
Clock 2 (C2)
On the second cycle, D1 (the data value associated with A1, the address asserted in C1)
should be driven onto MRDATA[31:0]. A1 must continue to be driven during this cycle.
TEST_IDATA_WRT continues to be asserted.
Clock 3 (C3)
On the third cycle, the next data RAM address, A2, is driven onto TEST_ADDR[14:2]. D1
can optionally be driven during this cycle. TEST_IDATA_WRT remains asserted during this
cycle.
Clock 4 (C4)
D2 should be driven onto MRDATA[31:0] during this cycle. TEST_IDATA_RD must be
asserted here for the length of this test. TEST_IDATA_WRT is negated during this cycle.
The actual WRITE to the ICACHE data array of the C1/C2 (A1/D1) access occurs during this
cycle. A2 must remain driven during this cycle.
C1
C2
C3
C4
C5
C6
C7
C8
C9
A1
A2
A3
TEST_RD
TEST_IDATA_WRT
TEST_ADDR
MRDATA
ICHT_ADDR
ICHD_DI
ICHD_DO
WRITE
READ
A4
D1
D2
D3
D4
D1
D2
A3
A2
A1
D1
D2
D3
D1
D2
D3
WRITE
READ
READ
WRITE
TEST_IDATA_RD
MWDATA
F
Freescale Semiconductor, Inc.
n
.
相關PDF資料
PDF描述
COLDFIRE2UMAD Version 2/2M ColdFire Core Processor User＇s Manual Addendum
COLDFIRE3UM Version 3 ColdFire Core User＇s Manual
COM150A 100V Single N-Channel Hi-Rel MOSFET in a TO-254AA package
COM2017P UART
COM2502P UART
相關代理商/技術參數(shù)
參數(shù)描述
COLDFIRE2UMAD 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Version 2/2M ColdFire Core Processor User＇s Manual Addendum
COLDFIRE3UM 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Version 3 ColdFire Core User＇s Manual
COLD-PACK 制造商:NTE Electronics 功能描述:
COLDS/002 制造商:Farnell / Duratool 功能描述:JOBBER DRILL SET 1.0-13.0X0.5MM
COLINKEX 制造商:Embest Info&Tech Co Ltd 功能描述:ADAPTER DEBUG SW/JTAG 制造商:EMBEST 功能描述:ADAPTER, DEBUG, SW/JTAG 制造商:EMBEST 功能描述:DEBUGGER, LPC13XX; Silicon Family Name:LPC13xx; Core Architecture:ARM; Core Sub-Architecture:Cortex-M3; IC Product Type:Debugger; Features:Support Cortex M0 and Cortex M3 Devices, Support Software & JTAG Debugging ;RoHS Compliant: Yes
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