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參數(shù)資料
| 型號(hào)： | CL-PD6722 |
| 廠商： | Cirrus Logic, Inc. |
| 英文描述： | ISA-TOOPC-CARD HOST ADAPTERS |
| 中文描述： | ISA的TOOPC卡主機(jī)適配器 |
| 文件頁數(shù)： | 91/128頁 |
| 文件大?。?/td> | 1591K |
| 代理商： | CL-PD6722 |
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CL-PD6710/’22
ISA–to–PC-Card Host Adapters
May 1997
91
PRELIMINARY DATA SHEET v3.1
ELECTRICAL SPECIFICATIONS
15.3 AC
Timing Specifications
This section includes system timing requirements for the CL-PD67XX. Timings are provided in nanosec-
onds (ns), at TTL input levels, with the ambient temperature varying from 0
°
C to 70
°
C, and V
CC
varying
from 3.0 to 3.6 V or 4.5 to 5.5 V DC. The AT bus speed is 10 MHz unless otherwise noted. Note that an
asterisk (*) denotes an active-low signal for the ISA bus interface, and a dash (-) denotes an active-low
signal for the PC Card socket interface.
Additionally, the following statements are true for all timing information:
G
All timings assume a load of 50 pF.
G
TTL signals are measured at TTL threshold; CMOS signals are measured at CMOS threshold.
Table 15-6. List of AC Timing Specifications
Title
Page Number
Table 15-7. ISA Bus Timing
92
Table 15-8. Reset Timing
94
Table 15-9. Pulse Mode Interrupt Timing
95
Table 15-10. General-Purpose Strobe Timing
96
Table 15-11. Input Clock Specification
97
Table 15-12. Memory Read/Write Timing (Word Access)
99
Table 15-13. Word I/O Read/Write Timing
100
Table 15-14. PC Card Read/Write Timing when System Is 8-Bit
102
Table 15-15. Normal Byte Read/Write Timing
103
Table 15-16. 16-Bit System to 8-Bit I/O Card: Odd Byte Timing
104
Table 15-17. DMA Read Cycle Timing (CL-PD6722 only)
105
Table 15-18. DMA Write Cycle Timing (CL-PD6722 only)
107
Table 15-19. DMA Request Timing (CL-PD6722 only)
109
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| CL-PS6700 | Low-Power PC Card Controller for the CL-PS7111 |
| CL-PS6700-VC-A | Low-Power PC Card Controller for the CL-PS7111 |
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參數(shù)描述 |
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