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參數(shù)資料
| 型號： | ADUC7032BSTZ-8V-RL |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 22/128頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC BATTERY SENSOR PREC 48-LQFP |
| 標準包裝： | 1 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心處理器： | ARM7 |
| 芯體尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 連通性： | LIN，SPI，UART/USART |
| 外圍設(shè)備： | POR，PSM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 9 |
| 程序存儲器容量： | 96KB（48K x 16） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1.5K x 32 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x16b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 48-LQFP |
| 包裝： | 標準包裝 |
| 其它名稱： | ADUC7032BSTZ-8V-RLDKR |
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Preliminary Technical Data
ADuC7032
Rev. PrD | Page 118 of 128
0
LHS Reset Bit
This bit is cleared to 0 by user code to enable the LHS logic to function normally
This bit is set to 1 by user code to reset all LHS logic to default conditions, the bit is cleared to 0 automatically in
hardware.
LIN Hardware Synchronization Control Register 1:
Name :
LHSCON1
Address :
0xFFFF078C
Default Value :
0x32
Access :
Read/Write
Function :
The LHS Control register is an 8-bit register that in conjunction with the LHSCON0 register is used to configure the
LIN mode of operation.
Table 83 : LHSCON1 MMR Bit Descriptions
Bit
Description
7-4
LIN STOP Edge Count
These 4 bits are set by user code to the number of falling or rising edges on which to stop the internal LIN
synchronization counter. The stop value of this counter can be read by user code via LHSVAL0. The type of edge, either
rising or falling, is configured by LHSCON0[7]. The default value of these bits is 0x3 which configures the hardware to
stop counting on the third falling edge. It should be noted that the first falling edge is taken as the falling edge at the
start of the LIN break pulse.
3-0
LIN START Edge Count
These 4 bits are set by user code to the number of falling edges after which the internal LIN synchronization timer will
start counting. The stop value of this counter can be read by user code via LHSVAL0. The default value of these bits is 0x2
which configures the hardware to start counting on the second falling edge. It should be noted that the first falling edge
is taken as the falling edge at the start of the LIN break pulse.
LIN Hardware Synchronization Timer0 Register :
Name :
LHSVAL0
Address :
0xFFFF0788
Default Value :
0x0000
Access :
Read/Write
Function :
The 16-bit read only LHSVAL0 register holds the value of the internal LIN synchronization timer. The
LIN synchronization timer is clocked from an internal 5MHz clock which is independent of Core clock and baud-rate
frequency. In LIN mode, the value read by user code from the LHSVAL0 register can be used calculate the master LIN
baud-rate. This calculation can then be used to configure the internal UART baud-rate to ensure correct LIN
communication via the UART from the ADuC7032 slave to the LIN master node.
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