參數(shù)資料
型號(hào)： UPD70F3357GJ(A)-GAE-AX
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, LEAD FREE, PLASTIC, LQFP-144
文件頁(yè)數(shù)： 512/1119頁(yè)
文件大小： 6653K
代理商： UPD70F3357GJ(A)-GAE-AX
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CHAPTER 11 FUNCTIONS OF WATCHDOG TIMER 2
User’s Manual U17790EJ2V0UD
451
11.3 Registers
(1) Watchdog timer mode register 2 (WDTM2)
The WDTM2 register sets the overflow time and operation clock of watchdog timer 2.
This register can be read or written in 8-bit units. This register can be read any number of times, but it can be
written only once following reset release.
Reset sets this register to 67H.
Caution
Accessing the WDTM2 register is prohibited in the following statuses. For details, refer to
3.4.9 (2) Accessing specific on-chip peripheral I/O registers.
When the CPU operates with the subclock and the main clock oscillation is stopped
When the CPU operates with the internal oscillation clock
0
WDTM2
WDM21
WDM20 WDCS24 WDCS23 WDCS22 WDCS21 WDCS20
After reset: 67H
R/W
Address: FFFFF6D0H
Stops operation
Non-maskable interrupt request mode
(generation of INTWDT2 signal)
Reset mode (generation of WDT2RES signal)
WDM21
0
1
WDM20
0
1
–
Selection of operation mode of watchdog timer 2
Cautions 1. For details of the WDCS20 to WDCS24 bits, see Table 11-2
Watchdog Timer 2 Clock
Selection.
2. Although watchdog timer 2 can be stopped just by stopping the operation of the internal
oscillator, clear the WDTM2 register to 00H to securely stop the timer (to avoid selection
of the main clock or subclock due to an erroneous write operation).
3. If the WDTM2 register is rewritten twice after reset, an overflow signal is forcibly
generated and the counter is reset.
4. To intentionally generate an overflow signal, write to the WDTM2 register only twice or
write a value other than “ACH” to the WDTE register once.
However, when watchdog timer 2 is set to stop operation, an overflow signal is not
generated even if data is written to the WDTM2 register only twice, or a value other than
“ACH” is written to the WDTE register only once.
5. To stop the operation of watchdog timer 2, set the RCM.RSTOP bit to 1 (to stop the
internal oscillator) and write 00H in the WDTM2 register. If the RCM.RSTOP bit cannot be
set to 1, set the WDCS23 bit to 1 (2
n/fXX is selected and the clock can be stopped in the
IDLE1, IDLW2, sub-IDLE, and subclock operation modes).
<R>
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UPD70F3347GJ 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
UPD70F3454F1-DA9-A 32-BIT, FLASH, 64 MHz, RISC MICROCONTROLLER, PBGA161
UPD71087G 71087 SERIES, 8-BIT TRANSCEIVER, INVERTED OUTPUT, PDSO20
UPD750066CU(A)-XXX 4-BIT, MROM, MICROCONTROLLER, PDIP42
UPD75306GF 4-BIT, MROM, 4.19 MHz, MICROCONTROLLER, PQFP80
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UPD70F3364GJ(A)-GAE-AX 制造商:Renesas Electronics Corporation 功能描述:
UPD70F3365GJ(A)-GAE-AX 制造商:Renesas Electronics Corporation 功能描述:RENUPD70F3365GJ(A)-GAE-AX 78K0R SERIES M
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