參數(shù)資料
型號(hào)： UPD70F3357GJ(A)-GAE-AX
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, LEAD FREE, PLASTIC, LQFP-144
文件頁數(shù)： 1084/1119頁
文件大?。?/td> 6653K
代理商： UPD70F3357GJ(A)-GAE-AX
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CHAPTER 24 STANDBY FUNCTION
User’s Manual U17790EJ2V0UD
967
Table 24-11. Operation After Releasing Sub-IDLE Mode by Interrupt Request Signal
Release Source
Interrupt Enabled (EI) Status
Interrupt Disabled (DI) Status
Non-maskable interrupt request
signal
Execution branches to the handler address.
Maskable interrupt request signal
Execution branches to the handler address
or the next instruction is executed.
The next instruction is executed.
(2) Releasing sub-IDLE mode by reset
The same operation as the normal reset operation is performed.
Table 24-12. Operating Status in Sub-IDLE Mode
Setting of Sub-IDLE Mode
Operating Status
Item
When Main Clock Is Oscillating
When Main Clock Is Stopped
Subclock oscillator
Oscillation enabled
Internal oscillator
Oscillation enabled
PLL
Operable
Stops operation
Note 1
CPU
Stops operation
DMA
Stops operation
Interrupt controller
Stops operation (but standby mode release is possible)
ROM correction
Stops operation
Timer P (TMP0 to TMP8)
Stops operation
Timer Q (TMQ0)
Stops operation
Timer M (TMM0)
Operable when fR/8 or fXT is selected as the count clock
Watch timer
Stops operation
Operable when fXT is selected as the
count clock
Watchdog timer 2
Operable when fR or fXT is selected as the count clock
CSIB0 to CSIB5
Operable when the SCKBn input clock is selected as the count clock (n = 0 to 5)
I
2C00 to I2C02
Stops operation
Serial interface
UARTA0 to UARTA3
Stops operation (but UARTA0 is operable when the ASCKA0 input clock is selected)
CAN controller
Stops operation
IEBus controller
Stops operation
A/D converter
Holds operation (conversion result held)
Note 2
D/A converter
Holds operation (output held
Note 2)
Real-time output function (RTO)
Stops operation (output held)
Key interrupt function (KR)
Operable
CRC arithmetic circuit
Stops operation
External bus interface
See 2.2 Pin States (same operation status as IDLE1, IDLE2 mode).
Port function
Retains status before sub-IDLE mode was set
Internal data
The CPU registers, statuses, data, and all other internal data such as the contents of
the internal RAM are retained as they were before the sub-IDLE mode was set.
Notes 1. Be sure to stop the PLL (PLLCTL.PLLON bit = 0) before stopping the main clock.
2. To realize low power consumption, stop the A/D and D/A converters before shifting to the sub-IDLE
mode.
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PDF描述
UPD70F3347GJ 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
UPD70F3454F1-DA9-A 32-BIT, FLASH, 64 MHz, RISC MICROCONTROLLER, PBGA161
UPD71087G 71087 SERIES, 8-BIT TRANSCEIVER, INVERTED OUTPUT, PDSO20
UPD750066CU(A)-XXX 4-BIT, MROM, MICROCONTROLLER, PDIP42
UPD75306GF 4-BIT, MROM, 4.19 MHz, MICROCONTROLLER, PQFP80
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UPD70F3358GJ(A)-UEN-A 制造商:Renesas Electronics Corporation 功能描述:
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UPD70F3365GJ(A)-GAE-AX 制造商:Renesas Electronics Corporation 功能描述:RENUPD70F3365GJ(A)-GAE-AX 78K0R SERIES M
UPD70F3365GJA 制造商:NEC Electronics Corporation 功能描述:
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