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參數(shù)資料
| 型號(hào)： | SYM53C876 |
| 廠商： | LSI Corporation |
| 英文描述： | PCI-Dual Channel SCSI Multi-Function Controller(PCI 雙通道SCSI多功能控制器) |
| 中文描述： | 的PCI -雙通道SCSI多功能控制器（雙通道的PCI的SCSI多功能控制器） |
| 文件頁數(shù)： | 125/285頁 |
| 文件大?。?/td> | 3341K |
| 代理商： | SYM53C876 |
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SYM53C876/876E Data Manual
4-33
Registers
SCSI Registers
Compare Data (bit 18) or Compare Phase (bit
17) bit is set.
5. A Transfer Control instruction is executed
with the reserved bit 22 set.
6. A Transfer Control instruction is executed
with the Wait for Valid phase bit (bit 16) set
while the chip is in target mode.
7. A Load/Store instruction is issued with the
memory address mapped to the operating
registers of the chip, not including ROM or
RAM.
8. A Load/Store instruction is issued when the
register address is not aligned with the
memory address
9. A Load/Store instruction is issued with bit 5
in the DCMD register clear or bits 3 or 2 set.
10. A Load/Store instruction when the count
value in the DBC register is not set at 1 to 4.
11. A Load/Store instruction attempts to cross a
dword boundary.
12. A Memory Move instruction is executed with
one of the reserved bits in the DCMD register
set.
13. A Memory Move instruction is executed with
the source and destination addresses not
aligned.
Register 0Dh
SCSI Status Zero (SSTAT0)
Read Only
Bit 7
ILF (SIDL Least Significant Byte
Full)
This bit is set when the least significant byte in
the SCSI Input Data Latch register (SIDL)
contains data. Data is transferred from the
SCSI bus to the SCSI Input Data Latch regis-
ter before being sent to the DMA FIFO and
then to the host bus. The SIDL register con-
tains SCSI data received asynchronously. Syn-
chronous data received does not flow through
this register.
Bit 6
ORF (SODR Least Significant Byte
Full)
This bit is set when the least significant byte in
the SCSI Output Data Register (SODR, a
hidden buffer register which is not accessible)
contains data. The SCSI logic uses the SODR
as a second storage register when sending data
synchronously. It is not readable or writable
by the user. It is possible to use this bit to
determine how many bytes reside in the chip
when an error occurs.
Bit 5
OLF (SODL Least Significant Byte
Full)
This bit is set when the least significant byte in
the SCSI Output Data Latch (SODL) con-
tains data. The SODL register is the interface
between the DMA logic and the SCSI bus. In
synchronous mode, data is transferred from
the host bus to the SODL register, and then to
the SCSI Output Data Register (SODR, a
hidden buffer register which is not accessible)
before being sent to the SCSI bus. In asyn-
chronous mode, data is transferred from the
host bus to the SODL register, and then to the
ILF
7
ORF
6
OLF
5
AIP
4
LOA
3
WOA
2
RST/
1
SDP0/
0
Default >>>
0
0
0
0
0
0
0
0
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