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參數(shù)資料
| 型號： | S1C63158D0A010P |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, FLASH, 4 MHz, MICROCONTROLLER, UUC53 |
| 封裝： | DIE-53 |
| 文件頁數(shù)： | 26/159頁 |
| 文件大?。?/td> | 1200K |
| 代理商： | S1C63158D0A010P |
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S1C63808 TECHNICAL MANUAL
EPSON
113
CHAPTER 4: PERIPHERAL CIRCUITS AND OPERATION (Power Supply for EPD Driver IC)
4.14.4 Adjustment of EPD driver voltages
The EPD driver voltages (VC1–VC3) can be adjusted in the software.
It is realized by controlling the voltages VC1 output from the EPD system voltage circuit.
The VC1 voltage for 1/3 bias can be adjusted to 8 levels as shown in Table 4.14.4.1 using the LC2–LC0
register. The VC1 voltage varies within the range from 1.03 to 1.23 V, and other voltages change according
to VC1.
The VC1 voltage for 1/2 bias can be adjusted to 16 levels as shown in Table 4.14.4.1 using the LC3–LC0
register. The VC1 voltage varies within the range from 1.08 to 1.84 V, and VC2 changes according to VC1.
Table 4.14.4.1 VC1 voltage value
No.
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
LC2
0
1
0
1
LC3
0
1
LC1
0
1
0
1
0
1
0
1
LC0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
1/2 bias
1.08
1.14
1.20
1.27
1.33
1.39
1.43
1.49
1.55
1.59
1.63
1.67
1.72
1.76
1.80
1.84
1/3 bias
1.03
1.06
1.09
1.12
1.15
1.18
1.20
1.23
–
VC1 (V)
When 1/2 bias is selected: VC2 = 2
× VC1, VC3 = VSS
When 1/3 bias is selected: VC2 = 2
× VC1, VC3 = 3 × VC1, LC3 is ineffective.
At initial reset, the LC3(LC2)–LC0 register is set to 0000B. The software should initialize the register to get
the desired contrast.
Note: To generate stable EPD driver voltages, the VDD voltage to be supplied to the IC must be higher
than the VC1 voltage that will be generated by setting the LC3–LC0 register to the maximum value
(7 for 1/3 bias or 15 for 1/2 bias).
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