參數(shù)資料
型號： PSD4256G6V-10UIT
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 1M X 8 FLASH, 52 I/O, PIA-GENERAL PURPOSE, PQFP80
封裝： PLASTIC, TQFP-80
文件頁數(shù)： 126/127頁
文件大?。?/td> 1091K
代理商： PSD4256G6V-10UIT
RESET timing and device status at RESET
PSD4256G6V
Table 53.
Status during Power-on RESET, Warm RESET, and Power-down mode
Port configuration
Power-on RESET
Warm Reset
Power-down mode
MCU I/O
Input mode
Unchanged
PLD output
Valid after internal PSD
configuration bits are
loaded
Valid
Depends on inputs to PLD
(addresses are blocked in
PD mode)
Address Out
Tri-stated
Not defined
Data Port
Tri-stated
Peripheral I/O
Tri-stated
Register
Power-On Reset
Warm Reset
Power-down mode
PMMR0 and PMMR2
Cleared to 0
Unchanged
Macrocells Flip-flop status
Cleared to 0 by internal
Power-On Reset
Depends on .re and .pr
equations
Depends on .re and .pr
equations
VM register(1)
Initialized, based on the
selection in PSDsoft
configuration menu
Initialized, based on the
selection in PSDsoft
configuration menu
Unchanged
All other registers
Cleared to 0
Unchanged
1.
The SR_code and Peripheral mode bits in the VM register are always cleared to '0' on Power-on RESET or Warm RESET.
相關PDF資料
PDF描述
PSD6407 POSITION SENSITIVE DETECTOR
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PSD853F2-15JIT 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52
PSD833F2-15M 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52
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參數(shù)描述
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