參數(shù)資料
型號: MC68F375BGMZP33
廠商: Freescale Semiconductor
文件頁數(shù): 561/616頁
文件大?。?/td> 0K
描述: IC MPU 32BIT 33MHZ 217-PBGA
標(biāo)準(zhǔn)包裝: 60
系列: M683xx
處理器類型: M683xx 32-位
速度: 33MHz
電壓: 5V
安裝類型: 表面貼裝
封裝/外殼: 217-BBGA
供應(yīng)商設(shè)備封裝: 217-PBGA(23x23)
包裝: 托盤
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MC68F375
INDEX
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
Index-5
EDOUT - bit in SICA 13-22
EMPTY 7-5
Emulation
control (EMU) 8-11
support 8-4
Emulation mode
selection 4-69
Emulator chip select (CSE) 4-69
Encoded
one of three channel priority levels (CH) 8-17
time function for each channel (CHANNEL) 8-15
type of host service (CH) 8-17
Ending queue pointer (ENDQP) 6-19
End-of-
frame (EOF) 7-16
End-of-queue condition 5-47
ENDQP 6-19, 6-24
Entry
table bank select field (ETBANK) 8-19
EOF 7-16
EOQ 5-17
ERRINT 7-32
Error
conditions 6-55
counters 7-9
interrupt (ERRINT) 7-32
ESTAT 7-31
ETBANK 8-19
ETRIG 5-5
event counter
FCSM 13-6
MCSM 13-11
Event timing 8-3
Exception
instruction (RTE) 4-49
processing 3-16, 4-55
sequence 3-18
types of exceptions 3-18
vectors 3-16
exception vector assignments 3-17
vector 4-55, 8-5
EXT 4-56
Extended message format 7-1
frames 7-5
External
bus
arbitration 4-50
interface (EBI) 4-1, 4-31
bus control signals 4-32
clock input timing diagram E-9
digital supply pin 5-6
multiplexing 5-9
reset (EXT) 4-56
trigger pins 5-5
trigger single-scan mode 5-20
Externally
multiplexed mode (MUX) 5-38
–F–
FAR 3-23
Fast
termination
read cycle timing diagram E-12
write cycle timing diagram E-13
termination cycles 4-38, 4-41
Fast quadrature decode TPU function (FQD) D-28
parameters
primary channel D-29
secondary channel D-30
FASTREF 4-6, 4-60
Fault confinement state (FCS) 7-10, 7-32
FC 4-34
FCSM
block diagram 13-5
clock sources 13-6
counter 13-5
counter overflow 13-8
counter register 13-9
driving the time base bus 13-8
effect of reset 13-5
event counter 13-6
flag clearing 13-8
freeze 13-6
input pin - CTMC 13-6, 13-8
interrupts 13-6
maximum external clock frequency 13-6, 13-8
registers
status/interrupt
control register (FCSMSIC) 13-7
reserved registers 13-7
selecting the clock source 13-8
setting the interrupt level 13-8, 13-36
using multiple FCSMs 13-7
FCSMCNT 13-9
FCSMSIC 13-7
Final sample time 5-12
FLAG
bit in DASMSIC 13-36
bit in SICA 13-21
FORCE - bit in SICA 13-21
FORMERR 7-31
FPSCK 8-19
FQCLK 5-25
FQD D-28
FQM D-10
Frame 6-50
size 6-55
Frames
overload 7-16
remote 7-16
Framing error (FE) flag 6-49, 6-55
FREEZ ACK 7-17
FREEZE
assertion response (FRZ)
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
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n
c
..
.
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PDF描述
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