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參數(shù)資料
| 型號(hào)： | MC68F375BGMZP33 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 310/616頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 32BIT 33MHZ 217-PBGA |
| 標(biāo)準(zhǔn)包裝： | 60 |
| 系列： | M683xx |
| 處理器類型： | M683xx 32-位 |
| 速度： | 33MHz |
| 電壓： | 5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 217-BBGA |
| 供應(yīng)商設(shè)備封裝： | 217-PBGA（23x23） |
| 包裝： | 托盤 |
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MC68F375
CDR MoneT FLASH FOR THE IMB3 (CMFI)
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
10-8
The module configuration register (CMFIMCR)
Array base address register (CMFIBAR)
CMFI EEPROM high voltage control register (CMFICTLx).
Control bits in these registers are provided to control array operation, programming
and erasing.
Some of the control registers have shadow information words which physically exist in
a spare CMFI EEPROM row. On master reset, some of the registers and fields within
certain registers are loaded with default reset information from the shadow information
words. Writing to a register does not alter the contents of the corresponding shadow
information word. Using the address of the corresponding control register, the shadow
information word is programmed in the same manner as a location in the CMFI
EEPROM array. When data is latched into the programming latches while program-
ming a shadow information word, it will not be written to the register itself. Data which
is programmed into the CMFIMCR, CMFIBAR or CMFICTL register’s shadow informa-
tion word will not be copied into the register until the next master reset.
The last write to a programming buffer prior to setting EHV determines the value to be
programmed. The registers that are loaded from shadow information words during
master reset are identified in the individual register field and control bit descriptions.
The shadow information words are erased whenever the low block (block 0) of the
array is erased.
10.4.1 CMFI EEPROM Module Control Block Addressing
The module control block is addressed by comparing the module control mapping
(IMODMAP) to IADDR[23] while IADDR[22:5] are decoded by the CMFI EEPROM
module. If the CMFI EEPROM control block address is decoded, the CMFI EEPROM
module will assert the address acknowledge (IAACKB) signal. The value of
IADDR[22:5] is defined for each device that has a CMFI EEPROM module. These bits
are fixed for a particular device (MCU or peripheral), and are specified by Motorola.
The value of the module control mapping (IMODMAP) is specified by a control bit in
the module configuration register, see 10.4.3 CMFI EEPROM Configuration Regis-
ter (CMFIMCR). The exact register addressing within the control block is determined
by IADDR[4:0]. The control block is restricted to supervisor data space (IFC[2:0] =
0b101). Any other address space read or write of the registers will not assert address
acknowledge. See Table 10-3 for control register offset addresses.
F
re
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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