參數(shù)資料
型號(hào)： MC68F375BGMZP33
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 122/616頁(yè)
文件大?。?/td> 0K
描述： IC MPU 32BIT 33MHZ 217-PBGA
標(biāo)準(zhǔn)包裝： 60
系列： M683xx
處理器類型： M683xx 32-位
速度： 33MHz
電壓： 5V
安裝類型： 表面貼裝
封裝/外殼： 217-BBGA
供應(yīng)商設(shè)備封裝： 217-PBGA（23x23）
包裝： 托盤
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MC68F375
QUEUED ANALOG-TO-DIGITAL CONVERTER MODULE-64
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
5-32
The same interrupt priority level can be assigned to more than one module. For exam-
ple, the QADC and the queued serial module (QSM) can both be assigned priority five.
If the QADC and the QSM request interrupt service simultaneously, then the interrupt
arbitration (IARB) fields in the respective module configuration registers are used to
determine which module is serviced first.
The IARB field is essentially a second-level priority in case of a tie. Each module that
can request interrupt service has an IARB field. Arbitration is per formed by means of
serial contention of IARB field bit values. Arbitration always takes place, even when a
single source requests service.
IARB fields contain four bits. An IARB value of 0b1111 has the highest arbitration pri-
ority, and 0b0001 has the lowest. If a module with an IARB field value of 0b0000
requests interrupt service, the bus master processes a spurious interrupt exception
because the module requesting the interrupt service cannot confirm that it made the
request. Initialization software must assign each IARB field a unique non-zero value in
order to implement the arbitration scheme. If two or more modules are assigned the
same non-zero IARB field value, operation is undefined when interrupts of the same
priority level are recognized.
5.11.5 Interrupt Vectors
When the QADC is the only module with an interrupt request pending at the level being
acknowledged, or when the QADC IARB value is higher than that of other modules
with requests pending at the acknowledged level, the QADC responds to the interrupt
acknowledge cycle with an 8-bit interrupt vector number. The CPU uses the vector
number to calculate a displacement into the exception vector table, then uses the vec-
tor at that location to jump to an interrupt service routine.
The interrupt vector base (IVB) field establishes the six high-order bits of the 8-bit inter-
rupt vector number, and the QADC provides two low-order bits which correspond to
one of the four internal QADC interrupt sources. Figure 5-11 shows the format of the
interrupt vector, and lists the binary coding of the two low-order bits for the four QADC
interrupt sources.
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Freescale Semiconductor, Inc.
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