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參數(shù)資料
| 型號： | MC68F375BGMZP33 |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 307/616頁 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT 33MHZ 217-PBGA |
| 標準包裝： | 60 |
| 系列： | M683xx |
| 處理器類型： | M683xx 32-位 |
| 速度： | 33MHz |
| 電壓： | 5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 217-BBGA |
| 供應商設(shè)備封裝： | 217-PBGA（23x23） |
| 包裝： | 托盤 |
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MC68F375
CDR MoneT FLASH FOR THE IMB3 (CMFI)
MOTOROLA
REFERENCE MANUAL
Rev. 25 June 03
10-5
The IMB3 provides a flexible, high performance bus capable of supporting a family of
parts.
Initialize program/erase sequence — The write to the high voltage control register
that changes the SES bit from a 0 to a 1.
Master reset — The hardware reset that resets the entire CMFI.
MoneT — The CMFI EEPROM’s FLASH bit cell.
Over programmed — By exceeding the specified programming time and/or voltage,
a CMFI bit may be over programmed. This bit causes erased bits in the same column
on the same array block to read as programmed.
Programming write — A word write to a CMFI array address to transfer information
into a program page buffer. The CMFI EEPROM accepts programming writes after ini-
tializing the program sequence until the EHV bit is changed from a 0 to a 1.
Program margin read — Special burst buffer updates of the CMFI array where the
CMFI EEPROM hardware adjusts the reference of the sense amplifier to check for cor-
rect program operation. All CMFI burst buffer updates between the first programming
write and clearing the SES bit are program margin reads.
Program page buffer — 64 bytes of information used to program the CMFI array. This
information is aligned to a 64-byte boundary within the CMFI array. Each CMFI module
has 1 program page buffer per block.
Read burst buffer — 32-byte block of information that is read from the CMFI array.
This information is aligned to a 32-byte boundary within the CMFI array. Each CMFI
module has two non-sequential burst buffers.
Reserved registers — A location within the control register block which may have one
or more bits that are reserved for use by Motorola. These bits are not available for nor-
mal use.
Shadow information — An extra row (256 bytes) of the CMFI array used to provide
reset configuration information. This row may be accessed by setting the SIE bit in the
module configuration register and accessing the CMFI array, see 10.4.3 CMFI
EEPROM Configuration Register (CMFIMCR). The shadow information is always in
the lowest array block of the CMFI array.
System reset — A reset generated under software control that clears the high voltage
enable (EHV) bit of the CMFICTL register and forces the BIU into a state ready to
receive a new IMB3 access.
10.2 CMFI EEPROM Interface
The CMFI module contains a slave BIU to the IMB3. The BIU controls access and
operation of the array through standard IMB3 reads and writes of the array and register
blocks in the CMFI module. Additionally, the CMFI uses external signals to provide
control and power to the module. These other external signals include an optional sig-
F
re
e
sc
a
le
S
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to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
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