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參數(shù)資料
| 型號(hào)： | MC16V1CPU20B1 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數(shù)： | 67/128頁 |
| 文件大小： | 571K |
| 代理商： | MC16V1CPU20B1 |
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MC68HC16V1
MOTOROLA
MC68HC16V1TS/D
43
3.6.2.3 Boot ROM Operation
The default configuration of the SLIM boot ROM and the CSB bootstrap chip-select can be overridden
by driving the ADDR11/DATA11 pin to the states shown in Table 24.
3.6.2.4 Boot Chip-Select Operation
The default operation of CSB/PD6 and the reset state of the chip-select control register (CSCR) CSB
data bus width bit (SIZB) can be overridden by driving the ADDR/DATA[7:6] pins to the states shown in
3.6.2.5 Clock Mode Selection
The default clock generation mode of the MCU can be overridden by driving the VDDSYN and FREEZE
pins to the states shown in Table 26.
3.6.2.6 Fast Reference Mode SYNCR Bit Settings
The default settings of the SYNCR X and W[2:0] bits in fast reference mode can be overridden by driving
the IRQX/BERR pin to the states shown in Table 27.
1. When VDDSYN is driven to logic 0, the MCU operates in external clock mode, regardless
of the state of PCON0 or FREEZE.
Table 24 Default Boot ROM Override
Shadow Bit
ADDR11/DATA11
SLIM Boot ROM
CSB Boot Chip-Select
MCR4
0
Enabled
Disabled
1
Disabled
Enabled
Table 25 Default Boot Chip-Select Operation Override
Shadow Bit
ADDR7/DATA7
ADDR6/DATA6
Pin Configuration
CSB Port Size
PCON[8:7]
0
PD6
8-bit
0
1
PD6
16-bit
1
0
CSB
8-bit
1
CSB
16-bit
Table 26 Default MCU Clock Source Override
Shadow Bit1
VDDSYN
FREEZE
Clock Generation Mode
PCON0
0
X
External clock mode
1
0
Fast reference mode
1
Slow reference mode
Table 27 Fast Reference Mode Default SYNCR Configuration Override
Shadow Bit
IRQX/BERR
SYNCR X Field
SYNCR W[2:0] Field
PCON2
0
1
000
1
0
011
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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