參數(shù)資料
型號： MC16V1CPU20B1
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP100
封裝： TQFP-100
文件頁數(shù)： 34/128頁
文件大?。?/td> 571K
代理商： MC16V1CPU20B1
MC68HC16V1
MOTOROLA
MC68HC16V1TS/D
13
The system test block incorporates hardware necessary for testing the MCU. It is used to perform fac-
tory tests, and its use in normal applications is not supported.
Table 7 shows the SLIM address map, which occupies 128 bytes. Unused registers within the 128-byte
address space return zeros when read.
Table 7 SLIM Address Map
Address
15
8
7
0
$YFFA001
SLIM MODULE CONFIGURATION REGISTER (SLIMCR)
$YFFA02
SLIM TEST REGISTER (SLIMTR)
$YFFA04
CLOCK SYNTHESIZER CONTROL REGISTER (SYNCR)
$YFFA06
NOT USED
RESET STATUS REGISTER (RSR)
$YFFA08
NOT USED
SLIM TEST REGISTER E (SLIMTRE)
$YFFA0A
MODULE CONFIGURATION SHADOW REGISTER (MCRC)
$YFFA0C
NOT USED
SUB-MODULE DISABLE (SMD)
$YFFA0E
PORT/CLOCK CONFIGURATION SHADOW REGISTER (PCON)
$YFFA10
PORT A OUTPUT DATA (PORTA)
PORT B OUTPUT DATA (PORTB)
$YFFA12
PORT A PIN DATA (PORTAP)
PORT B PIN DATA (PORTBP)
$YFFA14
NOT USED
PORT A/B DATA DIRECTION (DDRAB)
$YFFA16
RESERVED
$YFFA18
PORT C OUTPUT DATA (PORTC)
PORT D OUTPUT DATA (PORTD)
$YFFA1A
PORT C PIN DATA (PORTCP)
PORT D PIN DATA (PORTDP)
$YFFA1C
PORT C DATA DIRECTION (DDRC)
PORT D DATA DIRECTION (DDRD)
$YFFA1E
PORT C PIN ASSIGNMENT (PCPAR)
PORT D PIN ASSIGNMENT (PDPAR)
$YFFA20
NOT USED
PORT E OUTPUT DATA (PORTE)
$YFFA22
NOT USED
PORT E PIN DATA (PORTEP)
$YFFA24
NOT USED
PORT E DATA DIRECTION (DDRE)
$YFFA26
NOT USED
PORT E PIN ASSIGNMENT (PEPAR)
$YFFA28
PORT G OUTPUT DATA (PORTG)
PORT H OUTPUT DATA (PORTH)
$YFFA2A
PORT G PIN DATA (PORTGP)
PORT H PIN DATA (PORTHP)
$YFFA2C
PORT G DATA DIRECTION (DDRG)
PORT H DATA DIRECTION (DDRH)
$YFFA2E
RESERVED
$YFFA30
NOT USED
PORT F OUTPUT DATA (PORTF)
$YFFA32
NOT USED
PORT F PIN DATA (PORTFP)
$YFFA34
NOT USED
PORT F DATA DIRECTION (DDRF)
$YFFA36
PORT F PIN ASSIGNMENT (PFPAR)
$YFFA38
NOT USED
PORT F EDGE FLAGS (PORTFE)
$YFFA3A
NOT USED
PORT F EDGE-DETECT ENABLE
(PFEER)
$YFFA3C
PORT F LEVEL (PFLVR)
PORT F INTERRUPT VECTOR (PFIVR)
$YFFA3E
RESERVED
$YFFA40
TEST MODULE MASTER SHIFT A (TSTMSRA)
$YFFA42
TEST MODULE MASTER SHIFT B (TSTMSRB)
$YFFA44
TEST MODULE SHIFT COUNT (TSTSC)
$YFFA46
TEST MODULE REPETITION COUNTER (TSTRC)
$YFFA48
TEST MODULE CONTROL (CREG)
$YFFA4A
TEST MODULE DISTRIBUTED REGISTER (DREG)
$YFFA4C
RESERVED
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PDF描述
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