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參數(shù)資料
| 型號： | ZPSD813F1V |
| 英文描述： | Flash In System Programmable Mirocomputer Peripherals(閃速，在系統(tǒng)可編程微控制器外圍器件，1M位閃速存儲器，256K位EEPROM，16K位SRAM) |
| 中文描述： | Flash在系統(tǒng)可編程Mirocomputer外設（閃速，在系統(tǒng)可編程微控制器外圍器件，100萬位閃速存儲器，256K位的EEPROM，16K的位的SRAM） |
| 文件頁數(shù)： | 35/130頁 |
| 文件大小： | 650K |
| 代理商： | ZPSD813F1V |
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Prelimnary
PSD813F Famly
31
The
PSD813F
Functional
Blocks
(cont.)
Level 1
SRAM, I/O, or
Peripheral I/O
Level 2
EEPROM / Flash Boot
Memory
Highest Priority
Lowest Priority
Level 3
Flash Memory
Figure 7. Priority Level of Memory and I/OComponents
9.1.3.1. Memory Select Configuration for MCUs with Separate Programand Data Spaces
The 8031 and compatible family of microcontrollers, which includes the 80C51, 80C151,
80C251, and 80C51XA, have separate address spaces for code memory (selected using
PSEN) and data memory (selected using RD). Any of the memories within the PSD813F
can reside in either space or both spaces. This is controlled through manipulation of the VM
register that resides in the PSD’s CSIOP space.
The VM register is set using PSDsoft to have an initial value. It can subsequently be
changed by the microcontroller so that memory mapping can be changed on-the-fly.
For example, I may wish to have SRAM and Flash in Data Space at boot, and EEPROM in
Program Space at boot, and later swap EEPROM and Flash. This is easily done with
the VM register by using PSDsoft Configuration to configure it for boot up and having the
microcontroller change it when desired.
Table 13 describes the VM Register.
Bit 7
PIO_EN
Bit 6* Bit 5*
Bit 4
FL_Data EE_Data
Bit 3
Bit 2
FL_Code
Bit 1
EE_Code SRAM_Code
Bit 0
0 = disable
PIO mode
*
*
0 = RD
can’t
access
Flash
0 = RD
can’t
access
EEPROM/
Boot Flash
0 = PSEN
can’t
access
Flash
0 = PSEN
can’t
access
EEPROM/
Boot Flash
0 = PSEN
can’t
access
SRAM
1= enable
PIO mode
*
*
1 = RD
access
Flash
1 = RD
access
EEPROM/
Boot Flash
1 = PSEN
access
Flash
1 = PSEN
access
EEPROM/
Boot Flash
1 = PSEN
access
SRAM
Table 13. VM Register
NOTE:
Bits 6-5 are not used.
相關PDF資料 |
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